参数资料
型号: PIC12F635T-E/SN
元件分类: 微控制器/微处理器
英文描述: 8-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PDSO8
封装: 0.150 INCH, PLASTIC, MS-012, SOIC-8
文件页数: 9/196页
文件大小: 3291K
代理商: PIC12F635T-E/SN
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PIC12F635/PIC16F636/639
DS41232B-page 104
Preliminary
2005 Microchip Technology Inc.
FIGURE 11-19:
DETAILED SPI INTERFACE TIMING (AFE)
11.32.2.1
Clamp On Command
This command results in activating (turning on) the
modulation transistors of all enabled channels; channels
enabled in Configuration Register 0 (Register 11-1).
11.32.2.2
Clamp Off Command
This command results in de-activating (turning off) the
modulation transistors of all channels.
11.32.2.3
Sleep Command
This command places the AFE in Sleep mode –
minimizing current draw by disabling all but the
essential circuitry. Any other command wakes the AFE
(example: Clamp Off command).
11.32.2.4
Soft Reset Command
The AFE issues a Soft Reset when it receives an
external Soft Reset command. The external Soft Reset
command is typically used to end a SPI communication
sequence or to initialize the AFE for the next signal
detection sequence, etc. See Section 11.20 “Soft
Reset” for more details on Soft Reset.
If a Soft Reset command is sent during a “Clamp-on”
condition, the AFE still keeps the “Clamp-on” condition
after the Soft Reset execution. The Soft Reset is
executed in Active mode only, not in Standby mode.
The SPI Soft Reset command is ignored if the AFE is
not in Active mode.
11.32.2.5
AGC Preserve On Command
This command results in preserving the AGC level
during each AGC settling time and apply the value to
the data slicing circuit for the following data stream. The
preserved AGC value is reset by a Soft Reset, and a
new AGC value is acquired and preserved when it
starts a new AGC settling time. This feature is disabled
by an AGC Preserve Off command (see Section 11.19
11.32.2.6
AGC Preserve Off Command
This command disables the AGC preserve feature and
returns the AFE to the normal AGC tracking mode, fast
tracking during AGC settling time and slow tracking
11.32.3
CONFIGURATION REGISTERS
The AFE includes 8 Configuration registers, including a
column parity register and AFE Status register. All
registers are readable and writable via SPI, except
Status register, which is readable only. Bit 0 of each
register is a row parity bit (except for the AFE Status
Register 7) that makes the register contents an odd
number.
12
34
56
78
9
10
11
12
13
14
15
16
bi
t2
CS
SCLK
SDIO
Command
Data Byte
bi
t0
bi
t7
bi
t0
Address
Row
Parity Bit
bi
t0
bi
t3
MSb
LSb
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