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参数资料
型号： PIC12HV752-E/P
厂商： Microchip Technology
文件页数： 49/201页
文件大小： 0K
描述： IC MCU 8BIT 1024B FLASH 8-PDIP
标准包装： 60
系列： PIC® 12F
核心处理器： PIC
芯体尺寸： 8-位
速度： 20MHz
外围设备： 欠压检测/复位，POR，PWM，WDT
输入/输出数： 5
程序存储器容量： 1.75KB（1K x 14）
程序存储器类型： 闪存
RAM 容量： 64 x 8
电压 - 电源 (Vcc/Vdd)： 2 V ~ 5 V
数据转换器： A/D 4x10b
振荡器型： 内部
工作温度： -40°C ~ 125°C
封装/外壳： 8-DIP（0.300"，7.62mm）
包装： 管件
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页当前第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页
142
7682C–AUTO–04/08
AT90CAN32/64/128
13.11.15 Input Capture Register – ICR1H and ICR1L
13.11.16 Input Capture Register – ICR3H and ICR3L
The Input Capture is updated with the counter (TCNTn) value each time an event occurs on the
ICPn pin (or optionally on the Analog Comparator output for Timer/Counter1). The Input Capture
can be used for defining the counter TOP value.
The Input Capture Register is 16-bit in size. To ensure that both the high and low bytes are read
simultaneously when the CPU accesses these registers, the access is performed using an 8-bit
temporary high byte register (TEMP). This temporary register is shared by all the other 16-bit
registers. See “Accessing 16-bit Registers” on page 116.
13.11.17 Timer/Counter1 Interrupt Mask Register – TIMSK1
13.11.18 Timer/Counter3 Interrupt Mask Register – TIMSK3
Bit 7..6 – Reserved Bits
These bits are reserved for future use.
Bit 5 – ICIEn: Input Capture Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Countern Input Capture interrupt is enabled. The corresponding Interrupt
Vector (See “Interrupts” on page 60.) is executed when the ICFn flag, located in TIFRn, is set.
Bit 4 – Reserved Bit
This bit is reserved for future use.
Bit 3 – OCIEnC: Output Compare C Match Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Countern Output Compare C Match interrupt is enabled. The corresponding
Interrupt Vector (See “Interrupts” on page 60.) is executed when the OCFnC flag, located in
TIFRn, is set.
Bit
7
6
5
4
3
2
1
0
ICR1[15:8]
ICR1H
ICR1[7:0]
ICR1L
Read/Write
R/W
Initial Value
0
Bit
7
6
5
4
3
2
1
0
ICR3[15:8]
ICR3H
ICR3[7:0]
ICR3L
Read/Write
R/W
Initial Value
0
Bit
7
6
5
4
3
2
1
0
–
ICIE1
–
OCIE1C
OCIE1B
OCIE1A
TOIE1
TIMSK1
Read/Write
R
R/W
R
R/W
Initial Value
0
Bit
7
6
5
4
3
2
1
0
–
ICIE3
–
OCIE3C
OCIE3B
OCIE3A
TOIE3
TIMSK3
Read/Write
R
R/W
R
R/W
Initial Value
0
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PDF描述
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参数描述
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