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参数资料
| 型号： | PIC16F676-E/SL |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PDSO14 |
| 封装： | 3.90 MM, LEAD FREE, PLASTIC, SOIC-14 |
| 文件页数： | 7/132页 |
| 文件大小： | 1344K |
| 代理商： | PIC16F676-E/SL |
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PIC16F630/676
DS40039F-page 104
2010 Microchip Technology Inc.
FIGURE 12-10:
PIC16F676 A/D CONVERSION TIMING (NORMAL MODE)
TABLE 12-9:
PIC16F676 A/D CONVERSION REQUIREMENTS
Param
No.
Sym
Characteristic
Min
Typ
Max
Units
Conditions
130
TAD
A/D Clock Period
1.6
—
sTOSC based, VREF 3.0V
3.0*
—
sTOSC based, VREF full range
130
TAD
A/D Internal RC
Oscillator Period
3.0*
6.0
9.0*
s
ADCS<1:0> = 11 (RC mode)
At VDD = 2.5V
2.0*
4.0
6.0*
sAt VDD = 5.0V
131
TCNV
Conversion Time
(not including
Acquisition Time)(1)
—11
—
TAD Set GO bit to new data in A/D result
register
132
TACQ
Acquisition Time
(Note 2)
5*
11.5
—
s
The minimum time is the amplifier
settling time. This may be used if the
“new” input voltage has not changed
by more than 1 LSb (i.e., 4.1 mV @
4.096V) from the last sampled volt-
age (as stored on CHOLD).
134
TGO
Q4 to A/D Clock
Start
—TOSC/2
—
If the A/D clock source is selected as
RC, a time of TCY is added before
the A/D clock starts. This allows the
SLEEP
instruction to be executed.
* These parameters are characterized but not tested.
Data in “Typ” column is at 5.0V, 25
C unless otherwise stated. These parameters are for design guidance only
and are not tested.
Note 1: ADRES register may be read on the following TCY cycle.
2: See Table 7-1 for minimum conditions.
131
130
132
BSF ADCON0, GO
Q4
A/D CLK
A/D DATA
ADRES
ADIF
GO
SAMPLE
OLD_DATA
SAMPLING STOPPED
DONE
NEW_DATA
98
7
3
2
1
0
Note 1: If the A/D clock source is selected as RC, a time of TCY is added before the A/D clock starts. This allows the
SLEEP
instruction to be executed.
1 TCY
6
134
(TOSC/2)(1)
1 TCY
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