参数资料
型号: PIC18LC858-I/PT
厂商: Microchip Technology
文件页数: 59/246页
文件大小: 0K
描述: IC MCU OTP 16KX16 CAN 80TQFP
标准包装: 119
系列: PIC® 18C
核心处理器: PIC
芯体尺寸: 8-位
速度: 40MHz
连通性: CAN,I²C,SPI,UART/USART
外围设备: 欠压检测/复位,LVD,POR,PWM,WDT
输入/输出数: 68
程序存储器容量: 32KB(16K x 16)
程序存储器类型: OTP
RAM 容量: 1.5K x 8
电压 - 电源 (Vcc/Vdd): 2.5 V ~ 5.5 V
数据转换器: A/D 16x10b
振荡器型: 外部
工作温度: -40°C ~ 85°C
封装/外壳: 80-TQFP
包装: 托盘
其它名称: PIC18LC858I/PT
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2000 Microchip Technology Inc.
Advanced Information
DS30475A-page 151
PIC18CXX8
15.4.3
MASTER MODE
Master mode of operation is supported by interrupt
generation on the detection of the START and STOP
conditions. The STOP (P) and START (S) bits are
cleared from a RESET, or when the MSSP module is
disabled. Control of the I2C bus may be taken when the
P bit is set, or the bus is idle, with both the S and P bits
clear.
In Master mode, the SCL and SDA lines are manipu-
lated by the MSSP hardware.
The following events will cause SSP Interrupt Flag bit,
SSPIF, to be set (SSP Interrupt if enabled):
START condition
STOP condition
Data transfer byte transmitted/received
Acknowledge Transmit
Repeated START condition
15.4.4
I2C MASTER MODE SUPPORT
Master mode is enabled by setting and clearing the
appropriate SSPM bits in SSPCON1 and by setting the
SSPEN bit. Once Master mode is enabled, the user
has the following six options:
1.
Assert a START condition on SDA and SCL.
2.
Assert a Repeated START condition on SDA
and SCL.
3.
Write to the SSPBUF register initiating transmis-
sion of data/address.
4.
Generate a STOP condition on SDA and SCL.
5.
Configure the I2C port to receive data.
6.
Generate an Acknowledge condition at the end
of a received byte of data.
FIGURE 15-10: MSSP BLOCK DIAGRAM (I2C MASTER MODE)
Note:
The MSSP module, when configured in I2C
Master mode, does not allow queueing of
events. For instance, the user is not
allowed to initiate a START condition and
immediately write the SSPBUF register to
imitate transmission before the START
condition is complete. In this case, the
SSPBUF will not be written to and the
WCOL bit will be set, indicating that a write
to the SSPBUF did not occur.
Read
Write
SSPSR
START bit, STOP bit,
SSPBUF
Internal
Data Bus
Set/Reset, S, P, WCOL (SSPSTAT)
Shift
Clock
MSb
LSb
SDA
Acknowledge
Generate
SCL
SCL In
Bus Collision
SDA In
Receiv
e
E
nabl
e
Cl
o
c
k
C
n
tl
Clock
arbit
rat
e/
W
C
O
L
Det
e
ct
(hold
o
ff
clock
s
ource)
SSPADD<6:0>
Baud
Set SSPIF, BCLIF
Reset ACKSTAT, PEN (SSPCON2)
Rate
Generator
SSPM3:SSPM0
Note:
I/O pins have diode protection to VDD and VSS.
START bit Detect
STOP bit Detect
Write Collision Detect
Clock Arbitration
State Counter for
End of XMIT/RCV
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