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参数资料
| 型号： | PIC18LF8722T-I/PT |
| 厂商： | Microchip Technology |
| 文件页数： | 4/16页 |
| 文件大小： | 0K |
| 描述： | IC PIC MCU FLASH 64KX16 80TQFP |
| 产品培训模块： | Asynchronous Stimulus |
| 标准包装： | 1,200 |
| 系列： | PIC® 18F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 40MHz |
| 连通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，HLVD，POR，PWM，WDT |
| 输入/输出数： | 70 |
| 程序存储器容量： | 128KB（64K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 1K x 8 |
| RAM 容量： | 3.8K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2 V ~ 5.5 V |
| 数据转换器： | A/D 16x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 80-TQFP |
| 包装： | 带卷 (TR) |
PIC18F6627/6722/8627/8722
DS80221C-page 12
2006 Microchip Technology Inc.
37. Module: Reset
This version of silicon does not support the func-
tionality described in Note 1 of parameter D002 in
Section 28.1 “DC Characteristics: Supply
Voltage” of the data sheet. The RAM content may
be altered during a Reset event if the following
conditions are met.
Device is accessing RAM.
Asynchronous Reset (i.e., WDT, BOR or MCLR
occurs when a write operation is being
executed (start of a Q4 cycle).
Work around
None.
Date Codes that pertain to this issue:
All engineering and production devices.
38. Module: External Memory Bus
The A<19:16> EMB address lines and Read/Write
control pins (OE, WRH and WRL) are released to
their respective inactive states at the same time,
violating
the
timing
condition
mentioned
in
Figure 28-8 and Figure 28-9 in the Device Data
Sheet. This may result in a peripheral device on
the bus detecting an address change when a write/
read is initiated. The bus capacitance and signal
delay on the address and control lines can affect
the probability of invalid detection.
Work around
Two work arounds are available:
1. Use a latch based on the falling edge of ALE to
hold the A<19:16> signals.
2. Add a delay circuit to extend the valid time for
A<19:16> signals to ensure the address is
valid until read/write signals go inactive.
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