参数资料
型号: PUMA77S4000AI-025
英文描述: 128 MC CPLD,5 V ISP CPLD,100 PIN PQFP(EPLD)
中文描述: X32号的SRAM模块
文件页数: 6/10页
文件大小: 339K
代理商: PUMA77S4000AI-025
PUMA2/67/77S4000/A-020/025/35
Issue 4.3 : December 1999
5
Write Cycle No.1 Timing Waveform
Read Cycle Timing Waveform (1,2)
Notes:
(1) During the Read Cycle, WE is high for the modules.
(2) Address valid prior to or coincident with CS transition Low.
(3)
t
CHZ and tOHZ are defined as the time at which the outputs achieve the open circuit conditions and are not referenced
to output voltage levels. These parameters are sampled and not 100% tested.
t
RC
AA
OE
OH
A0~A16
OE
CS1~4
t OHZ(3)
t OLZ
t
ACS
t CLZ
t CHZ(3)
Data Valid
D0~31
High-Z
t AS(3)
t AW
t CW(4)
tWC
A0~A16
OE
CS1~4
t
WP(1)
t
OHZ(3,9)
WE1~4
D0~31out
t
DW
DH
D0~31in
(6)
t
WR (2)
tOW
High-Z
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