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参数资料
| 型号： | R8J73540BGZV |
| 厂商： | Renesas Electronics America |
| 文件页数： | 9/46页 |
| 文件大小： | 0K |
| 描述： | SH-MOBILE, PB-FREE |
| 产品培训模块： | Electromagnetic Noise Reduction Techniques Part 1 |
| 标准包装： | 1 |
| 系列： | SH-Mobile |
| 核心处理器： | SH-4A |
| 芯体尺寸： | 32-位 |
| 速度： | 216MHz |
| 连通性： | I²C |
| 外围设备： | DMA，LCD，WDT |
| 输入/输出数： | 144 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 16M x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.15 V ~ 1.3 V |
| 封装/外壳： | 模块 |
| 包装： | 托盘 |
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Peripherals
An interrupt request can be sent to the CPU on
completion of the specified number of transfers
Various DMAC transfer requests are provided:
– External request
– On-chip peripheral modules (Transfer requests from the
SCI, SCF, and TMU can be accepted on all channels.)
– Auto-request (A transfer request is generated
automatically within the DMAC)
Channel functions: different transfer modes
can be set for each channel
I Data Transfer Controller (DTC)
Transfer possible over any number of channels
3 transfer modes: normal, repeat, and block transfer
One activation source can trigger a number of data
transfers (chain transfer)
Direct specification of 32-bit address space
Activation by software allowed
Transfer can be set in byte, word, or longword units
I Host Interface (HIF)
Connectable to the main CPU with parallel bus
HIF boot function eliminates the need for boot ROM
I Motor Management Timer (MMT)
Triangular-wave comparison-type 6-phase PWM
waveform output with non-overlap dead times
Non-overlap times generated by timer’s dead time
counters decrease torque pulsations/harmonics for
improved voltage utilization
Toggle output synchronized with PWM period
PWM output halted by external signal
PWM duty programmable between 0 and 100%
Output-off functions
Adjustable carrier frequency for low switching losses
and less audible noise
I Multi-function Timer Unit (MTU)
Up to 12-phase PWM output with synchronous
operation
2-phase encoder pulse up/down count
Counter cascade mode to 32-bit counter
High sink current (15mA) for 6 pins; can directly
drive opto-isolators
A/D converter trigger signal can be generated
Dead time can be generated automatically
I Analog Interfaces
4- to 32-channel 10-bit successive-approximation
A/D converter
– Precise current detection for current control
– Three sample-and-holds with maximum conversion time
of 5.4 microseconds
2 channel 8-bit D/A converter
SuperH Main On-chip Peripherals
15
DTC
service
request
Interrupt
controller
On-chip 1KB RAM
Channel n
Interrupt
request
n + 1
n + 2
Source
Memory data
Destination
DMA Register
Source
Serial I/O
Destination
Memory
Data Transfer Controller Block Diagram
Main
CPU
LAN port
LAN
16 bits
Main CPU bus
SH7618
SH local bus
Flash
memory
Connectable with general bus
HIF
RAM
SH-2
Cache
E-
DMAC
Ether-C
PHY
SDRAM
Flash
memory
Optional
Boot ROM
SH7619
Host Interface Block Diagram
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PDF描述 |
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