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参数资料
| 型号： | SAF-C161O-LM HA |
| 厂商： | Infineon Technologies |
| 文件页数： | 42/66页 |
| 文件大小： | 0K |
| 描述： | IC MCU 16BIT ROM/LESS MQFP-80-1 |
| 标准包装： | 1 |
| 系列： | C16xx |
| 核心处理器： | C166 |
| 芯体尺寸： | 16-位 |
| 速度： | 20MHz |
| 连通性： | EBI/EMI，SPI，UART/USART |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 63 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 80-QFP |
| 包装： | 剪切带 (CT) |
| 其它名称： | SAF-C161O-LMHACT SAF-C161O-LMHACT-ND SAF-C161O-LMHAINCT |
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C161K
C161O
Data Sheet
43
V2.0, 2001-01
Address float after RdCS,
WrCS (with RW delay)
t44 CC –
0
–
0ns
Address float after RdCS,
WrCS (no RW delay)
t45 CC –
20
–
TCL
ns
RdCS to Valid Data In
(with RW delay)
t46 SR –
16 +
tC
–
2TCL - 24
+
tC
ns
RdCS to Valid Data In
(no RW delay)
t47 SR –
36 +
tC
–
3TCL - 24
+
tC
ns
RdCS, WrCS Low Time
(with RW delay)
t48 CC 30 + tC
–
2TCL - 10
+
tC
–
ns
RdCS, WrCS Low Time
(no RW delay)
t49 CC 50 + tC
–
3TCL - 10
+
tC
–
ns
Data valid to WrCS
t50 CC 26 + tC
–
2TCL - 14
+
tC
–
ns
Data hold after RdCS
t51 SR 0
–
0
–
ns
Data float after RdCS
t52 SR –
20 +
tF
–
2TCL - 20
+
tF
ns
Address hold after
RdCS, WrCS
t54 CC 20 + tF
–
2TCL - 20
+
tF
–
ns
Data hold after WrCS
t56 CC 20 + tF
–
2TCL - 20
+
tF
–
ns
1) These parameters refer to the latched chip select signals (CSxL). The early chip select signals (CSxE) are
specified together with the address and signal BHE (see figures below).
Multiplexed Bus (Standard Supply Voltage Range) (cont’d)
(Operating Conditions apply)
ALE cycle time = 6 TCL + 2
tA + tC + tF (120 ns at 25 MHz CPU clock without waitstates)
Parameter
Symbol
Max. CPU Clock
= 25 MHz
Variable CPU Clock
1 / 2TCL = 1 to 25 MHz
Unit
min.
max.
min.
max.
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参数描述 |
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