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参数资料
| 型号： | SAF-C161O-LM HA |
| 厂商： | Infineon Technologies |
| 文件页数： | 43/66页 |
| 文件大小： | 0K |
| 描述： | IC MCU 16BIT ROM/LESS MQFP-80-1 |
| 标准包装： | 1 |
| 系列： | C16xx |
| 核心处理器： | C166 |
| 芯体尺寸： | 16-位 |
| 速度： | 20MHz |
| 连通性： | EBI/EMI，SPI，UART/USART |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 63 |
| 程序存储器类型： | ROMless |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 80-QFP |
| 包装： | 剪切带 (CT) |
| 其它名称： | SAF-C161O-LMHACT SAF-C161O-LMHACT-ND SAF-C161O-LMHAINCT |
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C161K
C161O
Data Sheet
44
V2.0, 2001-01
AC Characteristics
Multiplexed Bus (Reduced Supply Voltage Range)
(Operating Conditions apply)
ALE cycle time = 6 TCL + 2
tA + tC + tF (150 ns at 20 MHz CPU clock without waitstates)
Parameter
Symbol
Max. CPU Clock
= 20 MHz
Variable CPU Clock
1 / 2TCL = 1 to 20 MHz
Unit
min.
max.
min.
max.
ALE high time
t5
CC
11 +
tA
–
TCL - 14
+
tA
–
ns
Address setup to ALE
t6
CC
5 +
tA
–
TCL - 20
+
tA
–
ns
Address hold after ALE
t7
CC
15 +
tA
–
TCL - 10
+
tA
–
ns
ALE falling edge to RD,
WR (with RW-delay)
t8
CC
15 +
tA
–
TCL - 10
+
tA
–
ns
ALE falling edge to RD,
WR (no RW-delay)
t9
CC
-10 +
tA –
-10 +
tA
–
ns
Address float after RD,
WR (with RW-delay)
t10 CC –
6
–
6ns
Address float after RD,
WR (no RW-delay)
t11 CC –
31
–
TCL + 6
ns
RD, WR low time
(with RW-delay)
t12 CC 34 + tC
–
2TCL - 16
+
tC
–
ns
RD, WR low time
(no RW-delay)
t13 CC 59 + tC
–
3TCL - 16
+
tC
–
ns
RD to valid data in
(with RW-delay)
t14 SR –
22 +
tC
–
2TCL - 28
+
tC
ns
RD to valid data in
(no RW-delay)
t15 SR –
47 +
tC
–
3TCL - 28
+
tC
ns
ALE low to valid data in
t16 SR –
45 +
tA
+
tC
–
3TCL - 30
+
tA + tC
ns
Address to valid data in
t17 SR –
57 + 2
tA
+
tC
–
4TCL - 43
+ 2
tA + tC
ns
Data hold after RD
rising edge
t18 SR 0
–
0
–
ns
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参数描述 |
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