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参数资料
| 型号： | SAK-XC866-1FRA3V |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 26.7 MHz, MICROCONTROLLER, PDSO38 |
| 封装： | PLASTIC, GREEN, TSSOP-38 |
| 文件页数： | 46/116页 |
| 文件大小： | 1640K |
| 代理商： | SAK-XC866-1FRA3V |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页当前第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页
XC866
Functional Description
Data Sheet
31
V1.2, 2007-10
CAH
ADC_RESR0L
Reset: 00H
Result Register 0 Low
Bit Field
RESULT[1:0]
0
VF
DRC
CHNR
Type
rh
r
rh
CBH
ADC_RESR0H
Reset: 00H
Result Register 0 High
Bit Field
RESULT[9:2]
Type
rh
CCH
ADC_RESR1L
Reset: 00H
Result Register 1 Low
Bit Field
RESULT[1:0]
0
VF
DRC
CHNR
Type
rh
r
rh
CDH
ADC_RESR1H
Reset: 00H
Result Register 1 High
Bit Field
RESULT[9:2]
Type
rh
CEH
ADC_RESR2L
Reset: 00H
Result Register 2 Low
Bit Field
RESULT[1:0]
0
VF
DRC
CHNR
Type
rh
r
rh
CFH
ADC_RESR2H
Reset: 00H
Result Register 2 High
Bit Field
RESULT[9:2]
Type
rh
D2H
ADC_RESR3L
Reset: 00H
Result Register 3 Low
Bit Field
RESULT[1:0]
0
VF
DRC
CHNR
Type
rh
r
rh
D3H
ADC_RESR3H
Reset: 00H
Result Register 3 High
Bit Field
RESULT[9:2]
Type
rh
RMAP = 0, Page 3
CAH
ADC_RESRA0L
Reset: 00H
Result Register 0, View A Low
Bit Field
RESULT[2:0]
VF
DRC
CHNR
Type
rh
CBH
ADC_RESRA0H
Reset: 00H
Result Register 0, View A High
Bit Field
RESULT[10:3]
Type
rh
CCH
ADC_RESRA1L
Reset: 00H
Result Register 1, View A Low
Bit Field
RESULT[2:0]
VF
DRC
CHNR
Type
rh
CDH
ADC_RESRA1H
Reset: 00H
Result Register 1, View A High
Bit Field
RESULT[10:3]
Type
rh
CEH
ADC_RESRA2L
Reset: 00H
Result Register 2, View A Low
Bit Field
RESULT[2:0]
VF
DRC
CHNR
Type
rh
CFH
ADC_RESRA2H
Reset: 00H
Result Register 2, View A High
Bit Field
RESULT[10:3]
Type
rh
D2H
ADC_RESRA3L
Reset: 00H
Result Register 3, View A Low
Bit Field
RESULT[2:0]
VF
DRC
CHNR
Type
rh
D3H
ADC_RESRA3H
Reset: 00H
Result Register 3, View A High
Bit Field
RESULT[10:3]
Type
rh
RMAP = 0, Page 4
CAH
ADC_RCR0
Reset: 00H
Result Control Register 0
Bit Field
VFCTR WFR
0
IEN
0
DRCT
R
Type
rw
r
rw
r
rw
CBH
ADC_RCR1
Reset: 00H
Result Control Register 1
Bit Field
VFCTR WFR
0
IEN
0
DRCT
R
Type
rw
r
rw
r
rw
CCH
ADC_RCR2
Reset: 00H
Result Control Register 2
Bit Field
VFCTR WFR
0
IEN
0
DRCT
R
Type
rw
r
rw
r
rw
CDH
ADC_RCR3
Reset: 00H
Result Control Register 3
Bit Field
VFCTR WFR
0
IEN
0
DRCT
R
Type
rw
r
rw
r
rw
CEH
ADC_VFCR
Reset: 00H
Valid Flag Clear Register
Bit Field
0
VFC3
VFC2
VFC1
VFC0
Type
r
w
RMAP = 0, Page 5
Table 11
ADC Register Overview (cont’d)
Addr Register Name
Bit
7
6543210
相关PDF资料 |
PDF描述 |
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