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参数资料
| 型号： | SAK-XC866-1FRA3V |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 26.7 MHz, MICROCONTROLLER, PDSO38 |
| 封装： | PLASTIC, GREEN, TSSOP-38 |
| 文件页数： | 94/116页 |
| 文件大小： | 1640K |
| 代理商： | SAK-XC866-1FRA3V |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页当前第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页
XC866
Functional Description
Data Sheet
75
V1.2, 2007-10
Data is transmitted or received on lines TXD and RXD, which are normally connected to
the pins MTSR (Master Transmit/Slave Receive) and MRST (Master Receive/Slave
Transmit). The clock signal is output via line MS_CLK (Master Serial Shift Clock) or input
via line SS_CLK (Slave Serial Shift Clock). Both lines are normally connected to the pin
SCLK. Transmission and reception of data are double-buffered.
Figure 31 shows the block diagram of the SSC.
Figure 31
SSC Block Diagram
PCLK
SS_CLK
RIR
TIR
EIR
Receive Int. Request
Transmit Int. Request
Error Int. Request
Control
Status
TXD(Master)
RXD(Slave)
Shift
Clock
MS_CLK
RXD(Master)
TXD(Slave)
Internal Bus
Baud-rate
Generator
Clock
Control
SSC Control Block
Register CON
Pin
Control
16-Bit Shift
Register
Transmit Buffer
Register TB
Receive Buffer
Register RB
相关PDF资料 |
PDF描述 |
|---|---|
| SAK-XC866-1FRA | 8-BIT, FLASH, 26.7 MHz, MICROCONTROLLER, PDSO38 |
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