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参数资料
| 型号： | SC101161DGMPVR2 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP112 |
| 封装： | LQFP-112 |
| 文件页数： | 131/142页 |
| 文件大小： | 6464K |
| 代理商： | SC101161DGMPVR2 |
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Device User Guide — 9S12DT128DGV2/D V02.15
89
Freescale Semiconductor
Section 21 Port Integration Module (PIM) Block Description
Consult the PIM_9DTB128 Block User Guide for information about the Port Integration Module.
Section 22 Voltage Regulator (VREG) Block Description
Consult the VREG Block User Guide for information about the dual output linear voltage regulator.
Section 23 Printed Circuit Board Layout Proposal
The PCB must be carefully laid out to ensure proper operation of the voltage regulator as well as of the
MCU itself. The following rules must be observed:
Every supply pair must be decoupled by a ceramic capacitor connected as near as possible to the
corresponding pins (C1 – C6).
Central point of the ground star should be the VSSR pin.
Table 23-1 Suggested External Component Values
Component
Purpose
Type
Value
C1
VDD1 lter cap
ceramic X7R
100 … 220nF
C2
VDD2 lter cap
ceramic X7R
100 … 220nF
C3
VDDA lter cap
ceramic X7R
100nF
C4
VDDR lter cap
X7R/tantalum
>= 100nF
C5
VDDPLL lter cap
ceramic X7R
100nF
C6
VDDX lter cap
X7R/tantalum
>= 100nF
C7
OSC load cap
C8
OSC load cap
C9 / CS
PLL loop lter cap
See PLL specication chapter
C10 / CP
PLL loop lter cap
C11 / CDC
DC cutoff cap
Colpitts mode only, if recommended by
quartz manufacturer
R1 / R
PLL loop lter res
See PLL Specication chapter
R2 / RB
Pierce mode only
R3 / RS
Q1
Quartz
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PDF描述 |
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