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参数资料
| 型号： | SED1330FBB |
| 元件分类： | 显示控制器 |
| 英文描述： | 640 X 256 DOTS DOT MAT LCD DSPL CTLR, PQFP60 |
| 封装： | PLASTIC, QFP6-60 |
| 文件页数： | 12/14页 |
| 文件大小： | 67K |
| 代理商： | SED1330FBB |
131
° Display Memory READ Timing
SED1330
tC
tCE
tAHC
tRCH
tASC
tRCS
tCE3
tOH2
tCEA
tACY
tCYR
tW
EXT
φO
VCE
VA0~VA15
VR/W
VD0~VD7
Signal
Parameter
Symbol
Rating
Unit
Remark
Min
Max
EXT
φ0
Clock cycle
tC
100
—
ns
VCE
VCE high-level pulse width
tW
tC – 40
—
ns
VCE low-level pulse width
tCE
2tC – 40
—
ns
Read cycle time
tCYR
*1
—
ns
VA0 to VA15
VCE address setup time (fall)
tASC
tC – 45
—
ns
VCE address hold time (fall)
tAHC
2tC – 40
—
ns
CL = 100 pF
VR/W
VCE read cycle setup time (fall)
tRCS
tC – 45
—
ns
+ 1TTL
VCE read cycle hold time (fall)
tRCH
tC/2 – 35
—
ns
Address access time
tACV
—*2
ns
VD0 to VD7
VCE access time
tCEA
—*3
ns
Output data hold time
tOH2
0—
ns
VCE data off time
tCE3
0—
ns
*1. tCYR = 3tC
*2. tACV = 3tC – 120
*3. tCEA = 2tC – 120
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