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参数资料
| 型号： | SED1336F0A |
| 元件分类： | 显示控制器 |
| 英文描述： | 640 X 256 DOTS DOT MAT LCD DSPL CTLR, PQFP60 |
| 封装： | PLASTIC, QFP6-60 |
| 文件页数： | 11/12页 |
| 文件大小： | 50K |
| 代理商： | SED1336F0A |
160
° Display Memory Read Timing
Signal
Symbol
Parameter
VDD = 4.5 to 5.5V
VDD = 3.0 to 4.5V
Unit
Condition
min
max
min
max
EXT
φ0tC
Clock period
100
—
125
—
ns
tW
VCE HIGH-level
tC – 50
—
tC – 50
—
ns
pulsewidth
tCE
VCE LOW-level
2tC – 30
—
2tC – 30
—
ns
pulsewidth
tCYR
Read cycle time
3tC
—3tC
—ns
tASC
Address setup time to
tC – 70
—
tC – 100
—
ns
falling edge of VCE
tAHC
Address hold time from
2tC – 30
—
2tC – 40
—
ns
falling edge of VCE
tRCS
Read cycle setup time
tC – 45
—
tC – 55
—
ns
VRD
to falling edge of VCE
tRCH
Read cycle hold time
0.5tC
—
0.5tC
—ns
from rising edge of VCE
tACV
Address access time
—
3tC – 100
—
3tC – 110
ns
VD0 to
tCEA
VCE access time
—
2tC – 80
—
2tC – 85
ns
VD7
tOH2
Output data hold time
0
—
0
—
ns
tCE3
VCE to data off time
0
—
0
—
ns
Ta = –20 to 75
°C
CL = 100 pF
EXT
Φ0
VCE
VA0 to VA15
VRD
VD0 to VD7
(SED1335F)
tC
tW
tCE
tW
tAHC
tASC
tCYR
tRCS
tCEA
tRCH
tCE3
tOH2
tACV
VCE
VA0 to
VA15
SED1336
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PDF描述 |
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