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参数资料
| 型号： | SI4322-A0-FT |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 4/22页 |
| 文件大小： | 0K |
| 描述： | IC RX FSK UNI 868/915MHZ 16TSSOP |
| 标准包装： | 96 |
| 频率： | 868MHz，915MHz |
| 灵敏度： | -104dBm |
| 数据传输率 - 最大： | 256 kbps |
| 调制或协议： | FSK |
| 应用： | 遥控，RKE，安全系统 |
| 电流 - 接收： | 14mA |
| 数据接口： | PCB，表面贴装 |
| 天线连接器： | PCB，表面贴装 |
| 特点： | 配有 RSSI |
| 电源电压： | 2.2 V ~ 3.8 V |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
Si4322
PIN DEFINITIONS
Pin type key: D=digital, A=analog, S=supply, I=input, O=output, IO=input/output
SDI
SCK
nSEL
1
2
3
16
15
14
VDI
ARSSI
VDD
SDO / FFIT
nIRQ
DATA / nFFE
DCLK / nFFS / CFIL
CLK
4
5
6
7
8
IA4322
13
12
11
10
9
IN1
IN2
VSS
nRES
XTL / REF
Pin
1
2
3
4
5
Name
SDI
SCK
nSEL
SDO / FFIT
nIRQ
Function
SDI
SCK
nSEL
SDO
FFIT
nIRQ
DATA
Type
DI
DI
DI
DO
DO
DO
DO
Description
Data input of serial control interface
Clock input of serial control interface
Chip select input of serial control interface (active low)
Serial data out for Status Read Command.
Tristate with bushold cell if nSEL= H
FIFO IT (active low)
Interrupt request output (active low)
Received data output (FIFO not used)
6
DATA / nFFS
nFFS
DCLK
DI
DO
FIFO select input
Received data clock output (digital filter used, FIFO not used)
7
8
DCLK
CLK
FFIT
CFIL
CLK
XTL
DO
AIO
DO
AIO
FIFO IT (active high) FIFO empty function can be achieved when FIFO
IT level is set to1
External data filter capacitor connection (analog filter used)
Clock output for the microcontroller
Crystal connection (other terminal of crystal to VSS)
9
XTL / REF
REF
DI
External reference input
10
11
12
13
14
15
16
nRES
VSS
IN2
IN1
VDD
ARSSI
VDI
nRES
VSS
IN2
IN1
VDD
ARSSI
VDI
DO
S
AI
AI
S
AO
DO
Reset output (active low)
Negative supply voltage
RF differential signal input
RF differential signal input
Positive supply voltage
Analog RSSI output
Valid Data Indicator output
4
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