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参数资料
| 型号： | SI5323-C-GM |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 25/40页 |
| 文件大小： | 0K |
| 描述： | IC MULTIPLIER/ATTENUATOR 36-QFN |
| 标准包装： | 490 |
| 系列： | DSPLL® |
| 类型： | 时钟乘法器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CML，CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.05GHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 1.71 V ~ 3.63 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 36-VFQFN 裸露焊盘 |
| 供应商设备封装： | 36-QFN（6x6） |
| 包装： | 托盘 |
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Si5323
Rev. 1.0
31
21
CS_CA
I/O
LVCMOS
Input Clock Select/Active Clock Indicator.
Input
: If manual clock selection mode is chosen
(AUTOSEL = L), this pin functions as the manual input
clock selector. This input is internally deglitched to
prevent inadvertent clock switching during changes in
the CS input state.
0 = Select CKIN1
1 = Select CKIN2
If configured as an input, this pin must be set high or
low.
Output
: If automatic clock selection mode is chosen
(AUTOSEL = M or H), this pin indicates which of the
two input clocks is currently the active clock. If alarms
exist on both CKIN1 and CKIN2, indicating that the
digital hold state has been entered, CA will indicate
the last active clock that was used before entering the
hold state.
0 = CKIN1 active input clock
1 = CKIN2 active input clock
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22
BWSEL1
BWSEL0
I
3-Level
Bandwidth Select.
Three level inputs that select the DSPLL closed loop
bandwidth. Detailed operations and timing characteristics for
these pins may be found in the Any-Frequency Precision
Clock Family Reference Manual.
These pins have both weak pull-ups and weak pull-downs
and default to M.
Some designs may require an external resistor voltage
divider when driven by an active device that will tri-state.
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25
24
FRQSEL3
FRQSEL2
FRQSEL1
FRQSEL0
I
3-Level
Multiplier Select.
www.silabs.com/timing (click on Documentation).
These pins have both weak pull-ups and weak pull-downs
and default to M.
Some designs may require an external resistor voltage
divider when driven by an active device that will tri-state.
29
28
CKOUT1–
CKOUT1+
OMulti
Clock Output 1.
Differential output clock with a frequency selected from a
table of values. Output signal format is selected by SFOUT
pins. Output is differential for LVPECL, LVDS, and CML
compatible modes. For CMOS format, both output pins drive
identical single-ended clock outputs.
Table 12. Si5323 Pin Descriptions (Continued)
Pin #
Pin Name
I/O
Signal Level
Description
相关PDF资料 |
PDF描述 |
|---|---|
| VE-B41-MY-F3 | CONVERTER MOD DC/DC 12V 50W |
| VE-B1Z-MY-F1 | CONVERTER MOD DC/DC 2V 20W |
| VE-B1Z-MX-F4 | CONVERTER MOD DC/DC 2V 30W |
| VE-B1Z-MW-F1 | CONVERTER MOD DC/DC 2V 40W |
| VE-B1Y-MY-F4 | CONVERTER MOD DC/DC 3.3V 33W |
相关代理商/技术参数 |
参数描述 |
|---|---|
| SI5323-C-GMR | 功能描述:时钟合成器/抖动清除器 Pin-Ctrl Clk Xplier Jitter Attn 2In/Out RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
| SI5323-EVB | 制造商:Silicon Laboratories Inc 功能描述: |
| SI5324 | 制造商:SILABS 制造商全称:SILABS 功能描述:Pin-Controlled 1_710 MHz Jitter Cleaning Clock |
| Si5324A-C-GM | 功能描述:时钟合成器/抖动清除器 Prec.Clk Mult/Jitter Atten. 2kHz-1.4 GHz RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
| SI5324A-C-GMR | 功能描述:时钟合成器/抖动清除器 Lo Loop BW Clk Multi Jitter Attn 2In/Out RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
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