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参数资料
| 型号： | SI5323-C-GM |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 8/40页 |
| 文件大小： | 0K |
| 描述： | IC MULTIPLIER/ATTENUATOR 36-QFN |
| 标准包装： | 490 |
| 系列： | DSPLL® |
| 类型： | 时钟乘法器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CML，CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.05GHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 1.71 V ~ 3.63 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 36-VFQFN 裸露焊盘 |
| 供应商设备封装： | 36-QFN（6x6） |
| 包装： | 托盘 |
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Si5323
16
Rev. 1.0
3.3. Frequency Plan Tables
The Si5323 provides flexible frequency plans for SONET, Datacom, and interworking between the two (Table 8,
Table 9, and Table 10 respectively). Both CKINn inputs must be the same Fin frequency and CKOUTn outputs as
specified in the tables.
1. All multiplication ratios are exact, but the frequency values are rounded.
2. For loop bandwidth settings, BWSEL[1:0], f3 values, and frequency operating ranges, consult the DSPLLsim
software configuration utility.
Table 8. SONET Clock Multiplication Settings (FRQTBL=L)
Plan #
FRQSEL
[3:0]
fIN (MHz)
Mult Factor
fOUT* (MHz)
0
LLLL
0.008
1
0.008
1
LLLM
2430
19.44
2
LLLH
4860
38.88
3
LLML
9720
77.76
4
LLMM
19440
155.52
5
LLMH
38880
311.04
6
LLHL
77760
622.08
7
LLHM
19.44
1
19.44
8
LLHH
2
38.88
9LMLL
4
77.76
10
LMLM
8
155.52
11
LMLH
8 x (255/238)
166.63
12
LMML
8 x (255/237)
167.33
13
LMMM
8 x (255/236)
168.04
14
LMMH
16
311.04
15
LMHL
32
622.08
16
LMHM
32 x (255/238)
666.51
17
LMHH
32 x (255/237)
669.33
18
LHLL
32 x (255/236)
672.16
19
LHLM
48
933.12
20
LHLH
54
1049.76
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参数描述 |
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