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参数资料
| 型号： | SL28504BZC |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 23/31页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN EAGLELAKE 64TSSOP |
| 标准包装： | 28 |
| 类型： | 时钟/频率发生器 |
| PLL： | 是 |
| 主要目的： | Intel CPU 服务器 |
| 输入： | 晶体 |
| 输出： | HCSL，LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:13 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 400MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-TFSOP （0.240"，6.10mm 宽） |
| 供应商设备封装： | 64-TSSOP |
| 包装： | 管件 |
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SL28504
........................ DOC #: SP-AP-0052 (Rev. AA) Page 3 of 31
5
PCI_3
O, SE 33 MHz clock.
6
PCI4 /SRC5_EN
I/O, SE 33 MHz clock output/3.3V-tolerant input for SRC enable
(Sampled on CKPWRGD assertion)
1 = SRC5, 0 =CPU_STOP#/PCI_STOP#
7
PCIF_0/ITP_EN
I/O, SE 3.3V LVTTL input to enable SRC8 or CPU2_ITP/33 MHz clock output. (sampled
on the CK_PWRGD assertion)
1 = CPU2_ITP, 0 = SRC8
8
VSS_PCI
GND
Ground for outputs.
9
VDD_48
PWR
3.3V Power supply for outputs and PLL.
10
USB_48/FSA
I/O
3.3V tolerant input for CPU frequency selection/fixed 48 MHz clock output. Refer
to DC Electrical Specifications table for Vil_FS and Vih_FS specifications.
11
VSS_48
GND
Ground for outputs.
12
VDD_IO
PWR
3.3V-1.05V Power supply for outputs.
13
SRC0/DOT96T
O, DIF 100 MHz Differential serial reference clocks/Fixed 96 MHz clock output. Selected
via I2C default is SRC0.
14
SRC0#/DOT96#
O, DIF 100 MHz Differential serial reference clocks/Fixed 96 MHz clock output. Selected
via I2C default is SRC0.
15
VSS_IO
GND
Ground for PLL2.
16
VDD_PLL3
PWR
3.3V Power supply for PLL3
17
SRC1/25M0_F
O, SE 100 MHz Differential serial reference clocks/ Free run 25MHz clock output
18
SRC1#/25M1_24.576M
O, SE 100 MHz Differential serial reference clocks/ 25MHz clock output/24.576MHz clock
output
19
VSS_PLL3
GND
Ground for PLL3.
20
VDD_PLL3_IO
PWR
3.3V-1.05V power supply for PLL3
21
SRC2_SATA
O, DIF 100 MHz Differential serial reference clocks.
22
SRC2#_SATA#
O, DIF 100 MHz Differential serial reference clocks.
23
VSS_SRC
GND
Ground for outputs.
24
SRC3 / CR#_C
I/O,
DIF
100 MHz differential serial reference clock output /3.3V Clock Request #_C/D
input
Selected via CR#_C_EN/CR#_D_EN bit located in byte 5 bit 3and 1.
The CR#_C_SEL and CR#_D_SEL bits in byte 5 bit 2 and 0 will select which SRC
to stop when asserted
25
SRC3# / CR#_D
I/O,
DIF
100 MHz differential serial reference clock output/3.3V Clock Request #_C/D
input
Selected via CR#_C_EN/CR#_D_EN bit located in byte 5 bit 3and 1.
The CR#_C_SEL and CR#_D_SEL bits in byte 5 bit 2 and 0 will select which SRC
to stop when asserted
26
VDD_SRC_IO
PWR
3.3V-1.05V power supply for SRC outputs.
27
SRC4
O, DIF 100 MHz Differential serial reference clocks.
28
SRC4#
O, DIF 100 MHz Differential serial reference clocks.
29
VSS_SRC
GND
Ground for outputs.
30
SRC9
O, DIF 100 MHz Differential serial reference clocks.
31
SRC9#
O, DIF 100 MHz Differential serial reference clocks.
32
SRC11#/ CR#_G
I/O,
DIF
100 MHz differential serial reference clocks/3.3V CR#_G Input.
Selected via CR#_G_EN/CR#_H_EN bit located in byte 6 bit 5 and 4.
When selected, CR#_G controls SRC9, CR#_H controls SRC10
33
SRC11/ CR#_H
I/O,
DIF
100 MHz Differential serial reference clocks/3.3V CR#_H Input.
Selected via CR#_G_EN/CR#_H_EN bit located in byte 6 bit 5 and 4.
When selected, CR#_G controls SRC9, CR#_H controls SRC10
64-TSSOP Pin Definitions
Pin No.
Name
Type
Description
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相关代理商/技术参数 |
参数描述 |
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| SL28504BZCT | 功能描述:时钟发生器及支持产品 Syst Clock Intel Eaglake RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
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