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参数资料
| 型号： | SPAK56854FG120 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| 封装： | LQFP-128 |
| 文件页数： | 26/649页 |
| 文件大小： | 7965K |
| 代理商： | SPAK56854FG120 |
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Resets
MOTOROLA
System Integration Module (SIM)
4-17
Preliminary
4
clock, to retain their value once the part is powered on. See TOD, COP, OSC chapters.
The RST_CGM is re-timed to the OSC_CLK and is used to reset the CGM module, in turn
using the oscillator clock directly. The RST_PERIPH reset is used to reset everything else.
Standards require the part to be held in reset during boundary scan operations. When the
BSCAN_EBL input is asserted, all resets used within the SIM and all reset outputs of the
SIM will go to their active asserted state. This prevents accidental damage due to random
inputs applied during boundary scan testing.
The power modes discussed in the next chapter affect reset function. COP reset is not
honored if the OSC module is in its low power mode since the OSC module shuts off all
clocking to the part and without a clock, the SIM can’t see the synchronous COP reset.
COP reset will be honored immediately upon return to run mode when clocks resume.
There are two ways to permit a COP reset to be honored in Stop mode; either set
OMR6_SD (core register OMR6 bit SD) or set TOD_SEL in the CGM control register.
Setting OMR6_SD configures for fast Stop mode recovery. Setting TOD_SEL selects the
CGM’s time-of-day clock prescaler for use rather than the one in the OSC module. Either,
or both, prevent the OSC from shutting off its clock outputs. In turn, this provides an
active CLK_MSTR input to the SIM, allowing an immediate COP reset. The Software
Reset is only operable in Run mode when the CPU can write to the SIM control register to
activate Software Reset. The low power modes and controls are explained in detail in the
next chapter.
相关PDF资料 |
PDF描述 |
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| SPAKDSP303GC100 | 制造商:Motorola Inc 功能描述: |
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