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参数资料
| 型号： | SPL505YC264BTT |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 8/27页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK CK505 BEARLAKE 64TSSOP |
| 标准包装： | 2,000 |
| 类型： | 时钟/频率发生器，多路复用器 |
| PLL： | 是 |
| 主要目的： | Intel CPU，PCI Express（PCIe） |
| 输入： | 晶体 |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:22 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 400MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 85°C |
| 安装类型： | * |
| 封装/外壳： | * |
| 供应商设备封装： | * |
| 包装： | * |
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SPL505YC26
....................Document #: 001-03543 Rev *E Page 16 of 27
CPU_STP# Deassertion
The deassertion of the CPU_STP# signal will cause all CPU
outputs that were stopped to resume normal operation in a
synchronous manner, synchronous manner meaning that no
short or stretched clock pulses will be produce when the clock
resumes. The maximum latency from the deassertion to active
outputs is no more than two CPU clock cycles.
CP U_ S T P #
CP UT
CP UC
Figure 4. CPU_STP# Assertion Waveform
CPU_STP#
CPUT
CP UC
CP UT Internal
T drive_CPU_ST P#,10 ns>200 mV
CP UC Internal
CPU_STP# Deassertion Waveform
CPUC(Stoppable)
CPUT(Stoppable)
CPUC(Free Running
CPUT(Free Running
PD#
1.8mS
CPU_STOP#
DOT96C
DOT96T
CPU_STP# = Driven, CPU_PD = Driven, DOT_PD = Driven
相关PDF资料 |
PDF描述 |
|---|---|
| D38999/26JE26JA | CONN PLUG 26POS STRAIGHT W/SCKT |
| V24B28H250B3 | CONVERTER MOD DC/DC 28V 250W |
| ICS932S200BFLFT | IC FREQ TIMING GENERATOR 56-SSOP |
| MS27473E24B4S | CONN PLUG 56POS STRAIGHT W/SCKT |
| V24B24H250BG2 | CONVERTER MOD DC/DC 24V 250W |
相关代理商/技术参数 |
参数描述 |
|---|---|
| SPL5100PT | 制造商:CHENMKO 制造商全称:Chenmko Enterprise Co. Ltd. 功能描述:SCHOTTKY BARRIER RECTIFIER |
| SPL520LLPT | 制造商:CHENMKO 制造商全称:Chenmko Enterprise Co. Ltd. 功能描述:SCHOTTKY BARRIER RECTIFIER |
| SPL53-1024 | 制造商:Power-One 功能描述: |
| SPL53-4000 | 制造商:Power-One 功能描述: |
| SPL-53-DR-IR1-CDA | 制造商:SOURCE 制造商全称:Source Photonics, Inc. 功能描述:SFP Bi-Directional Transceiver Preliminary |
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