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参数资料
| 型号： | SSM2518CBZ-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 22/48页 |
| 文件大小： | 0K |
| 描述： | IC AMP AUD PWR 2C STER D 16WLCSP |
| 产品变化通告： | 8mm Carrier Tape Changes 28/Feb/2012 |
| 标准包装： | 10,000 |
| 类型： | D 类 |
| 输出类型： | 2 通道（立体声） |
| 在某负载时最大输出功率 x 通道数量： | 2.5W x 2 @ 4 欧姆 |
| 电源电压： | 2.5 V ~ 5.5 V |
| 特点： | 消除爆音，数字输入，I²C，I²S，静音，短路和热保护，关机，音量控制 |
| 安装类型： | 表面贴装 |
| 供应商设备封装： | 16-WLCSP（2.21x2.21） |
| 封装/外壳： | 16-WFBGA，WLCSP |
| 包装： | 带卷 (TR) |
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Data Sheet
SSM2518
Rev. A | Page 29 of 48
SERIAL AUDIO INTERFACE CONTROL REGISTER
Address: 0x03, Reset: 0x00, Name: Serial_Interface_Control
Table 16. Bit Descriptions for Serial_Interface_Control
Bits
Bit Name
Settings
Description
Reset
Access
7
BCLK_GEN
Internal BCLK Generator Enable.
0x0
RW
0
Bit clock from BCLK pin is used
1
Internally generated bit clock is used
6
LRCLK_MODE
LRCLK Shape Selection. Required only for TDM modes.
0x0
RW
0
50% duty cycle
1
1-bit pulse
5
LRCLK_POL
LRCLK Polarity.
0x0
RW
0
Rising edge (normal)
1
Falling edge (inverted)
4
SAI_MSB
Serial Data Bit Order.
0x0
RW
0
MSB first
1
LSB first
[3:2]
SLOT_WIDTH
TDM Slot Width. Required only for TDM modes.
0x0
RW
00
32 BCLK cycles per slot
01
24 BCLK cycles per slot
10
16 BCLK cycles per slot
11
Reserved
1
BCLK_EDGE
BCLK Active Edge.
0x0
RW
0
Rising BCLK edge used
1
Falling BCLK edge used
0
RESERVED
Reserved.
0x0
RW
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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