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参数资料
型号： SSTV16859EC,518
厂商： NXP SEMICONDUCTORS
元件分类： 锁存器
英文描述： SSTV SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PBGA96
封装： 13.50 X 5.50 MM, 1.05 MM HEIGHT, PLASTIC, SOT-536-1, LFBGA-96
文件页数： 9/14页
文件大小： 118K
代理商： SSTV16859EC,518
Philips Semiconductors
Product data
SSTV16859
2.5 V 13-bit to 26-bit SSTL_2
registered buffer for stacked DDR DIMM
2002 Feb 19
4
56-TERMINAL CONFIGURATION
14
13
12
11
10
1
2
3
4
5
6
7
8
9
56
55
54
53
52
51
50
49
48
47
46
45
44
43
29
30
31
32
33
42
41
40
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38
37
36
35
34
15
16
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19
20
21
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26
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28
Q7A
Q6A
Q5A
Q4A
Q3A
Q2A
Q1A
Q13B
VDDQ
Q12B
Q11B
Q10B
Q9B
Q8B
Q7B
Q6B
V
Q5B
Q4B
Q3B
Q2B
Q1B
D1
D2
D3
DDQ
V
DDQ
V
DDI
V
DDQ
D10
D9
D8
D7
GND
CLK
D6
D5
D4
VREF
VDDI
VDDQ
Q8B
Q9A
V
Q10A
Q1
1A
Q12A
Q13A
D13
D12
D1
1
DDQ
GND
V
DDQ
V
DDI
V
DDQ
SW01040
CLK
RESET
TERMINAL DESCRIPTION
TERMINAL
NUMBER
SYMBOL
NAME AND FUNCTION
1, 2, 3, 4, 5, 6,
7, 50, 51, 52,
53, 54, 56
Q13A–Q1A
Data output
10, 11, 12, 13,
14, 15, 16, 18,
19, 20, 21, 22
Q13B–Q1B
Data output
9, 17, 23, 27,
34, 44, 49, 55
VDDQ
Power supply voltage
26, 33, 45
VDDI
Power supply voltage
37, 48
GND
Ground
24, 25, 28, 29,
30, 31, 39, 40,
41, 42, 43, 46,
47
D1–D13
Data input: clocked in on the
crossing of the rising edge of CK
and the falling edge of CK
32
VREF
Input reference voltage
35, 36
CK, CK
Positive and negative master
clock input
51
RESET
Asynchronous reset input:
resets registers and disables
data and clock differential input
receivers
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参数描述
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