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参数资料
| 型号： | ST72F324BLJ4TAE |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | 10 X10 MM, LEAD FREE, LQFP-44 |
| 文件页数： | 131/197页 |
| 文件大小： | 2960K |
| 代理商： | ST72F324BLJ4TAE |
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ST72324BLxx-Auto
Interrupts
39/197
7.2.3
Non-maskable sources
These sources are processed regardless of the state of the I1 and I0 bits of the CC register
(see Figure 13: Interrupt processing flowchart on page 37). After stacking the PC, X, A and
CC registers (except for RESET), the corresponding vector is loaded in the PC register and
the I1 and I0 bits of the CC are set to disable interrupts (level 3). These sources allow the
processor to exit halt mode.
●
TRAP (non maskable software interrupt)
This software interrupt is serviced when the TRAP instruction is executed. It will be serviced
according to the flowchart in Figure 13: Interrupt processing flowchart on page 37.
●
Reset
The reset source has the highest priority in the ST7. This means that the first current routine
has the highest software priority (level 3) and the highest hardware priority. See Section 6.5:
7.2.4
Maskable sources
Maskable interrupt vector sources can be serviced if the corresponding interrupt is enabled
and if its own interrupt software priority (in ISPRx registers) is higher than the one currently
being serviced (I1 and I0 in CC register). If any of these two conditions is false, the interrupt
is latched and thus remains pending.
●
External interrupts
External interrupts allow the processor to exit from halt low power mode. External interrupt
sensitivity is software selectable through the external interrupt control register (EICR).
External interrupt triggered on edge will be latched and the interrupt request automatically
cleared upon entering the interrupt service routine. If several input pins of a group
connected to the same interrupt line are selected simultaneously, these will be logically
ORed.
●
Peripheral interrupts
Usually the peripheral interrupts cause the MCU to exit from halt mode except those
mentioned in the Table 14: Interrupt mapping on page 47. A peripheral interrupt occurs
when a specific flag is set in the peripheral status registers and if the corresponding enable
bit is set in the peripheral control register. The general sequence for clearing an interrupt is
based on an access to the status register followed by a read or write to an associated
register.
Note:
The clearing sequence resets the internal latch. A pending interrupt (that is, waiting to be
serviced) will therefore be lost if the clear sequence is executed.
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PDF描述 |
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| ST72F324J2TAE | 功能描述:8位微控制器 -MCU 5V RANGE 8B MCU RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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