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参数资料
| 型号： | ST72F324BLJ4TAE |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP44 |
| 封装： | 10 X10 MM, LEAD FREE, LQFP-44 |
| 文件页数： | 184/197页 |
| 文件大小： | 2960K |
| 代理商： | ST72F324BLJ4TAE |
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ST72324BLxx-Auto
On-chip peripherals
87/197
Note:
1
After a write instruction to the OCiHR register, the output compare function is inhibited until
the OCiLR register is also written.
2
The OCF1 and OCF2 bits cannot be set by hardware in PWM mode therefore the output
compare interrupt is inhibited.
3
The ICF1 bit is set by hardware when the counter reaches the OC2R value and can produce
a timer interrupt if the ICIE bit is set and the I bit is cleared.
4
In PWM mode the ICAP1 pin cannot be used to perform input capture because it is
disconnected to the timer. The ICAP2 pin can be used to perform input capture (ICF2 can be
set and IC2R can be loaded) but the user must take care that the counter is reset each
period and ICF1 can also generates interrupt if ICIE is set.
5
When the pulse width modulation (PWM) and one pulse mode (OPM) bits are both set, the
PWM mode is the only active one.
10.3.4
Low power modes
10.3.5
Interrupts
Table 31.
Effect of low power modes on 16-bit timer
Mode
Description
Wait
No effect on 16-bit timer.
Timer interrupts cause the device to exit from wait mode.
Halt
16-bit timer registers are frozen.
In halt mode, the counter stops counting until halt mode is exited. Counting resumes from
the previous count when the MCU is woken up by an interrupt with ‘exit from halt mode’
capability or from the counter reset value when the MCU is woken up by a reset.
If an input capture event occurs on the ICAPi pin, the input capture detection circuitry is
armed. Consequently, when the MCU is woken up by an interrupt with ‘exit from halt mode’
capability, the ICFi bit is set, and the counter value present when exiting from halt mode is
captured into the ICiR register.
Table 32.
16-bit timer interrupt control/wake-up capability(1)
1.
The 16-bit timer interrupt events are connected to the same interrupt vector (see Section 7: Interrupts on
page 36). These events generate an interrupt if the corresponding enable control bit is set and the interrupt
mask in the CC register is reset (RIM instruction).
Interrupt event
Event flag Enable control bit
Exit from wait
Exit from halt
Input capture 1 event/counter
reset in PWM mode
ICF1
ICIE
Yes
No
Input capture 2 event
ICF2
Output compare 1 event
(not available in PWM mode)
OCF1
OCIE
Output compare 2 event
(not available in PWM mode)
OCF2
Timer overflow event
TOF
TOIE
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