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参数资料
| 型号： | ST72F521AR6T6 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | 10 X 10 MM, PLASTIC, TQFP-64 |
| 文件页数： | 54/216页 |
| 文件大小： | 4744K |
| 代理商： | ST72F521AR6T6 |
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ST72F521, ST72521B
147/215
CONTROLLER AREA NETWORK (Cont’d)
10.8.5.3 Unexpected message transmission
Symptom:
The previous message received by pCAN, even if
this message did not pass the receive filter, will be
retransmitted by pCAN with a correct identifier and
DLC but with corrupted data. The data bytes will
be a copy of the identifier bytes IDHR and IDLR in
the following repetitive pattern:
DATA_0 = IDHR
DATA_1 = IDLR
DATA_2 = IDHR
DATA_3 = IDLR
etc.
DATA_7 = IDLR
If no message has been received before the prob-
lem occurs then identifier byte values are random
but the data bytes are in the same repetitive pat-
tern.
Details:
The buffers of the pCAN cell are configurable as
receive or transmit buffers. By default, all buffers
are configured in reception. To use a buffer to
transmit a CAN message the application has to re-
serve this buffer for transmission by setting the
LOCK bit in the BCSR register. So the buffer is
then locked for any further reception and reserved
for transmission.
Once a transmission has been requested by a
write access to data byte 7 of the buffer the appli-
cation might need to abort this transmission re-
quest. To do so, the application can reset the
LOCK bit in the BCSR register.
If the message is pending (RDY bit set) but not
currently being transmitted, then clearing the
LOCK bit will abort it immediately.
If the message is pending (RDY bit set) and cur-
rently being transmitted then the message will not
be interrupted but the CAN core will wait until the
end of this transmission attempt. Then software
must clear the LOCK bit again to abort the trans-
mission.
An unexpected transmission can occur:
IF the application resets the LOCK bit
WHILE
the
CAN
core
is
preparing
the
transmission1) AND there is no other transmission
pending in another buffer
THEN the LOCK bit is reset but the transmission is
not stopped. Instead the content of the page 0
buffer will be transmitted.
Impact On The Application:
pCAN will echo some messages sent by other
nodes. Identifier and DLC will be correct but data
are corrupted as described previously.
Note 1: The preparation lasts two bit times just be-
fore SOF, this is the critical window during which
the LOCK bit must not be reset by the application.
相关PDF资料 |
PDF描述 |
|---|---|
| ST72F521AR9T3 | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64 |
| ST72F521M9T3 | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP80 |
| ST72F521R6T6 | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64 |
| ST72F521M9TC | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP80 |
| ST72F521R6TC | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| ST72F521AR6TC | 制造商:STMicroelectronics 功能描述:MCU 8BIT ST7 CISC 32KB FLASH 5V 64TQFP - Trays |
| ST72F521AR9T3 | 制造商:STMicroelectronics 功能描述:60K TQFP64 - Trays |
| ST72F521AR9T6 | 功能描述:8位微控制器 -MCU Flask 60K SPI/SCI/I2 RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| ST72F521AR9TC | 功能描述:8位微控制器 -MCU Flask 60K SPI/SCI/I2 RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| ST72F521AR9TC A3 | 制造商:STMicroelectronics 功能描述: |
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