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参数资料
| 型号： | ST7PLUSA2M6TR |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDSO8 |
| 封装： | 0.150 INCH, ROHS COMPLIANT, PLASTIC, SOP-8 |
| 文件页数： | 133/136页 |
| 文件大小： | 1705K |
| 代理商： | ST7PLUSA2M6TR |
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Obsolete
Product(s)
- Obsolete
Product(s)
Obsolete
Product(s)
- Obsolete
Product(s)
Electrical characteristics
ST7LITEUS2, ST7LITEUS5
12.3.3
Auxiliary voltage detector (AVD) thresholds
TA = 40 to 125°C, unless otherwise specified.
12.3.4
Internal RC oscillator
To improve clock stability and frequency accuracy, it is recommended to place a decoupling
capacitor, typically 100 nF, between the VDD and VSS pins as close as possible to the ST7
device.
Internal RC oscillator calibrated at 5.0 V
The ST7 internal clock can be supplied by an internal RC oscillator (selectable by option
byte).
Table 48.
Operating characteristics with AVD(1)
1.
Refer to Section : Monitoring the VDD main supply.
Symbol
Parameter
Conditions
Min
(2)
2.
Not tested in production, guaranteed by characterization.
Typ
Max
Unit
VIT+(AVD)
1 => 0 AVDF flag toggle threshold
(VDD rise)
High threshold
Med. threshold
Low threshold
4.0
3.4
2.6
4.4
3.7
2.9
4.8
4.1
3.2
V
VIT-(AVD)
0 => 1 AVDF flag toggle threshold
(VDD fall)
High threshold
Med. threshold
Low threshold
3.9
3.3
2.5
4.3
3.6
2.8
4.7
4.0
3.1
Vhys
AVD voltage threshold hysteresis
VIT+(AVD)-VIT-(AVD)
150
mV
Table 49.
Voltage drop between AVD flag set and LVD reset generation
Parameter
Min (1)
1.
Not tested in production, guaranteed by characterization.
Typ (1)
Max (1)
Unit
AVD med. threshold - AVD low. threshold
800
850
950
mV
AVD high. threshold - AVD low threshold
1400
1450
1550
AVD high. threshold - AVD med. threshold
600
650
750
AVD low threshold - LVD low threshold
100
200
250
AVD med. threshold - LVD low threshold
950
1050
1150
AVD med. threshold - LVD med. threshold
250
300
400
AVD high. threshold - LVD low threshold
1600
1700
1800
AVD high. threshold - LVD med. threshold
900
1000
1050
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