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参数资料
| 型号： | ST7PSCR1R4T1 |
| 厂商： | 意法半导体 |
| 英文描述： | 8-BIT LOW-POWER, FULL-SPEED USB MCU WITH 16K FLASH, 768 RAM, SMARTCARD I/F, TIMER |
| 中文描述： | 8位低功耗，全速USB微控制器与16K的闪存，768内存，智能卡的I /楼，计时器 |
| 文件页数： | 31/102页 |
| 文件大小： | 1413K |
| 代理商： | ST7PSCR1R4T1 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页当前第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页
ST7SCR
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I/O PORTS
(Cont’d)
9.3 I/O Port Implementation
The hardware implementation on each I/O port de-
pends on the settings in the DDR register and spe-
cific feature of the I/O port such as true open drain.
9.3.1 Port A
Table 9. Port A Description
Figure 21. PA0, PA1, PA2, PA3, PA4, PA5 Configuration
Figure 22. PA6 Configuration
PORT A
I / O
Input
Output
PA[5:0]
without pull-up *
push-pull or open drain with software selectable pull-up
PA6
without pull-up
-
*Reset State
DR
DDR
LATCH
LATCH
DR SEL
DDR SEL
V
DD
PAD
ALTERNATE ENABLE
ALTERNATE ENABLE
ALTERNATE ENABLE
ALTERNATE
OUTPUT
ALTERNATE INPUT
PULL-UP
1)
P-BUFFER
N-BUFFER
1
0
1
0
CMOS SCHMITT TRIGGER
V
SS
V
DD
DIODES
D
Note 1:
selectable by PAPUCR register
DR SEL
PAD
V
DD
DIODES
D
CMOS SCHMITT TRIGGER
1
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