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参数资料
| 型号： | STK14C88-W35M |
| 元件分类： | SRAM |
| 英文描述： | 32K X 8 NON-VOLATILE SRAM, 35 ns, PDIP32 |
| 封装： | 0.600 INCH, PLASTIC, DIP-32 |
| 文件页数： | 8/13页 |
| 文件大小： | 387K |
| 代理商： | STK14C88-W35M |
STK14C88
September 2003
4
Document Control # ML0014 rev 0.1
SRAM WRITE CYCLES #1 & #2
(VCC = 5.0V ± 10%)e
Note j:
If W is low when E goes low, the outputs remain in the high-impedance state.
Note k: E or W must be
≥ VIH during address transitions.
Note l:
HSB must be high during SRAM WRITE cycles.
SRAM WRITE CYCLE #1: W Controlledk, l
SRAM WRITE CYCLE #2: E Controlledk, l
NO.
SYMBOLS
PARAMETER
STK14C88-25
STK14C88-35
STK14C88-45
UNITS
#1
#2
Alt.
MIN
MAX
MIN
MAX
MIN
MAX
12
tAVAV
tWC
Write Cycle Time
25
35
45
ns
13
tWLWH
tWLEH
tWP
Write Pulse Width
20
25
30
ns
14
tELWH
tELEH
tCW
Chip Enable to End of Write
20
25
30
ns
15
tDVWH
tDVEH
tDW
Data Set-up to End of Write
10
12
15
ns
16
tWHDX
tEHDX
tDH
Data Hold after End of Write
0
ns
17
tAVWH
tAVEH
tAW
Address Set-up to End of Write
20
25
30
ns
18
tAVWL
tAVEL
tAS
Address Set-up to Start of Write
0
ns
19
tWHAX
tEHAX
tWR
Address Hold after End of Write
0
ns
20
tWZ
Write Enable to Output Disable
10
13
15
ns
21
tWHQX
tOW
Output Active after End of Write
5
ns
PREVIOUS DATA
DATA OUT
E
ADDRESS
tAVAV
W
tWHDX
DATA IN
tWHAX
tWLWH
tAVWL
tAVWH
DATA VALID
tWLQZ
tDVWH
HIGH IMPEDANCE
tWHQX
tELWH
DATA IN
tAVAV
tEHDX
tWLEH
tEHAX
tAVEL
tAVEH
DATA VALID
tDVEH
HIGH IMPEDANCE
tELEH
DATA OUT
E
ADDRESS
W
DATA IN
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