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参数资料
| 型号： | STM32W108HBU72 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, QCC40 |
| 封装： | 6 X 6 MM, 0.50 MM PITCH, ROHS COMPLIANT, VFQFPN-40 |
| 文件页数： | 14/198页 |
| 文件大小： | 2871K |
| 代理商： | STM32W108HBU72 |
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General-purpose timers
STM32W108CB, STM32W108HB
110/198
Doc ID 16252 Rev 3
Figure 28 gives an overview of the external trigger input block.
Figure 28.
External trigger input block
For example, to configure the up-counter to count each 2 rising edges on ETR, use the
following procedure:
●
As no filter is needed in this example, write TIM_ETF = 0000 in the TIMx_SMCR
register.
●
Set the prescaler by writing TIM_ETPS = 01 in the TIMx_SMCR register.
●
Select rising edge detection on ETR by writing TIM_ETP = 0 in the TIMx_SMCR
register.
●
Enable external clock mode 2 by writing TIM_ECE = 1 in the TIMx_SMCR register.
●
Enable the counter by writing TIM_CEN = 1 in the TIMx_CR1 register.
The counter counts once each 2 ETR rising edges.
The delay between the rising edge on ETR and the actual clock of the counter is due to the
resynchronization circuit on the ETRP signal.
Figure 29.
Control circuit in external clock mode 2
10.1.4
Capture/compare channels
Each capture/compare channel is built around a capture/compare register including a
shadow register, an input stage for capture with digital filter, multiplexing and prescaler, and
an output stage with comparator and output control.
Figure 30 gives an overview of one capture/compare channel. The input stage samples the
corresponding TIy input to generate a filtered signal (TIyF). Then an edge detector with
相关PDF资料 |
PDF描述 |
|---|---|
| S9S12XF512J0CLH | MICROCONTROLLER, QFP64 |
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| SAK-XC2264N-16F66L | 32-BIT, FLASH, 66 MHz, RISC MICROCONTROLLER, PQFP100 |
| STK17TA8-RF45ITR | 1 TIMER(S), PROGRAMMABLE TIMER, PDSO48 |
| SST55LD040M-133-I-BZJE | IDE COMPATIBLE, FLASH MEMORY DRIVE CONTROLLER, PBGA145 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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