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参数资料
| 型号： | STM32W108HBU72 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, QCC40 |
| 封装： | 6 X 6 MM, 0.50 MM PITCH, ROHS COMPLIANT, VFQFPN-40 |
| 文件页数： | 8/198页 |
| 文件大小： | 2871K |
| 代理商： | STM32W108HBU72 |
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STM32W108CB, STM32W108HB
General-purpose timers
Doc ID 16252 Rev 3
105/198
reload value, whereas the prescalar's counter restarts from 0, but the prescale rate doesn't
change.
In addition, if the TIM_URS bit in the TIMx_CR1 register is set, setting the TIM_UG bit
generates an update event, but without setting the INT_TIMUIF flag. Thus no interrupt
request is sent. This avoids generating both update and capture interrupts when clearing the
counter on the capture event.
When an update event occurs, the update flag (the INT_TIMUIF bit in the INT_TIMxFLAG
register) is set (unless TIM_USR is 1) and the following registers are updated:
●
The prescaler shadow register is reloaded with the buffer value (contents of the
TIMx_PSC register).
●
The auto-reload active register is updated with the buffer value (contents of the
TIMx_ARR register). The auto-reload is updated before the counter is reloaded, so that
the next period is the expected one.
frequencies when TIMx_ARR = 0x36.
Figure 20.
Counter timing diagram, internal clock divided by 1
Figure 21.
Counter timing diagram, internal clock divided by 4
Center-aligned mode (up/down counting)
In center-aligned mode, the counter counts from 0 to the auto-reload value (contents of the
TIMx_ARR register) - 1 and generates a counter overflow event, then counts from the
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PDF描述 |
|---|---|
| S9S12XF512J0CLH | MICROCONTROLLER, QFP64 |
| SAF-XC2263N-40F20L | 32-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP100 |
| SAK-XC2264N-16F66L | 32-BIT, FLASH, 66 MHz, RISC MICROCONTROLLER, PQFP100 |
| STK17TA8-RF45ITR | 1 TIMER(S), PROGRAMMABLE TIMER, PDSO48 |
| SST55LD040M-133-I-BZJE | IDE COMPATIBLE, FLASH MEMORY DRIVE CONTROLLER, PBGA145 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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