参数资料
型号: STP1081ABGA-125
元件分类: 微控制器/微处理器
英文描述: SPECIALTY MICROPROCESSOR CIRCUIT, PBGA256
封装: PLASTIC, BGA-256
文件页数: 5/32页
文件大小: 478K
代理商: STP1081ABGA-125
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Companion Device for 250/300 MHz UltraSPARC-II Systems
UltraSPARC
-II Data Buffer (UDB-II)
STP1081
Preliminary
July 1997
TIMING CONSIDERATIONS
General
The UDB-II will not stall data delivery to UltraSPARC-II on a correctable error or an uncorrectable error.
The number of transaction cycles on the data bus are as follows:
One for noncacheable stores (128 bits)
Four for mondo vectors (192 bits)
Four for cache lines (512 bits)
Timing Diagrams
Four Timing Modes
The clock relationships between the various combinations and timing possibilities are shown in Figure 7.
Figure 7. Timing Comparisons between EBUS_CLK and SYS_CLK Cases
EBUS_CLK
SYS_CLK
2:3 Mode
EBUS_CLK
SYS_CLK
1:2 Mode
EBUS_CLK
SYS_CLK
1:1 Mode, Case 1
EBUS_CLK
SYS_CLK
1:1 Mode, Case 2
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PDF描述
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