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参数资料
| 型号： | STR715FZ0T1TR |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 66 MHz, RISC MICROCONTROLLER, PQFP144 |
| 封装： | 20 X 20 MM, MS-026-BFB, LQFP-144 |
| 文件页数： | 40/78页 |
| 文件大小： | 2018K |
| 代理商： | STR715FZ0T1TR |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页当前第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页
STR71xF
Electrical parameters
45/78
Table 22.
PLL2 characteristics
Symbol
Parameter
Test conditions
Value
Unit
Min
Typ
Max
fPLLCLK2
PLL multiplier output
clock
140
MHz
fPLL2
PLL input clock
FREF_RANGE = 0
1.5
3.0
MHz
FREF_RANGE = 1
3.0
5
MHz
tLOCK2
PLL lock time
FREF_RANGE = 0
Stable Input Clock
Stable V33IOPLL, V18
300
s
FREF_RANGE = 1
Stable Input Clock
Stable V33IOPLL, V18
600
s
tJITTER2 PLL jitter (peak to peak)
tPLL = 4 MHz, MX[1:0]=’11’
Global Output division = 32
(Output Clock = 2 MHz)
0.7
2
ns
Table 23.
Low-power mode wakeup timing
Symbol
Parameter
Typ
Unit
tWULPWFI Wakeup from LPWFI mode
26(1)
1.
Clock selected is CK2_16, Main VReg OFF and Flash in power-down
s
tWUSTOP
Wakeup from STOP mode
2048
CLK
Cycles
(2)
2.
The CLK clock is derived from the external oscillator.
tWUSTBY
Wakeup from STANDBY mode
2048 CLK Cycles
+ 8 CLK2 Cycles(3)
3.
Refer to Figure 7. Reset General Timing in the STR71xF Reference Manual (UM0084)
Cycles
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PDF描述 |
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