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参数资料
| 型号： | STR715FZ0T1TR |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 66 MHz, RISC MICROCONTROLLER, PQFP144 |
| 封装： | 20 X 20 MM, MS-026-BFB, LQFP-144 |
| 文件页数： | 58/78页 |
| 文件大小： | 2018K |
| 代理商： | STR715FZ0T1TR |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页当前第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页
STR71xF
Electrical parameters
61/78
Notes:
1.
Data based on standard I2C protocol requirement, not tested in production.
2.
The device must internally provide a hold time of at least 300 ns for the SDA signal in order to bridge the
undefined region of the falling edge of SCL.
3.
The maximum hold time th(SDA) is not applicable.
4.
Measurement points are done at CMOS levels: 0.3xVDD and 0.7xVDD.
5.
fPCLK1, must be at least 8 MHz to achieve max fast I
2C speed (400 kHz).
6.
The following table gives the values to be written in the I2CCCR register to obtain the required I2C SCL line
frequency.
Table 36.
I2C characteristics
Symbol
Parameter
Standard mode
I2C
Fast mode I2C5)
Unit
Min 1)
Max 1)
Min 1)
Max 1)
tw(SCLL)
SCL clock low time
4.7
1.3
s
tw(SCLH)
SCL clock high time
4.0
0.6
tsu(SDA)
SDA setup time
250
100
ns
th(SDA)
SDA data hold time
0 3)
0 2)
900 3)
tr(SDA)
tr(SCL)
SDA and SCL rise time
1000
20+0.1Cb
300
tf(SDA)
tf(SCL)
SDA and SCL fall time
300
20+0.1Cb
300
th(STA)
START condition hold time
4.0
0.6
s
tsu(STA)
Repeated START condition setup
time
4.7
0.6
tsu(STO)
STOP condition setup time
4.0
0.6
s
tw(STO:STA)
STOP to START condition time (bus
free)
4.7
1.3
s
Cb
Capacitive load for each bus line
400
pF
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
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