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参数资料
| 型号： | TLC32047I |
| 厂商： | Texas Instruments, Inc. |
| 英文描述： | Wide-Band Analog Interface Circuit |
| 中文描述： | 宽带模拟接口电路 |
| 文件页数： | 12/61页 |
| 文件大小： | 303K |
| 代理商： | TLC32047I |
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1–4
FRAME SYNCHRONIZATION FUNCTIONS
TLC32047 Function
Frame Sync Output
Receiving serial data on DX from processor to internal DAC
FSX low
Transmitting serial data on DR from internal ADC to processor, primary communications
FSR low
Transmitting serial data on DR from DATA-DR to processor, secondary communications in
dual-word (telephone interface) mode only
FSD low
TLC32047
Logic Levels
TTL or CMOS
TMS320C30,
or Equivalent
16-Bit DSP
TMS320C25,
TMS32020,
–5 V
5 V
FSD
D11OUT
Serial Data Out
5
DR
Serial Data In
DX
DATA-DR
or CMOS Logic Levels
16-Bit Format TTL
Secondary Communication (see Table above)
Serial Data Input
13
Analog Out
Analog In
OUT–
OUT+
IN–
IN+
FSR
D10OUT
FSX
VCC–
VCC+
20
19
26
25
22
21
1
4
3
12
14
11
Figure 1–1. Dual-Word (Telephone Interface) Mode
When the DATA-DR/CONTROL input is tied to a logic signal source varying between 0 and 5 V, the
TLC32047 is in the dual-word (telephone interface) mode. This logic signal is routed to the DR line for input
to the DSP only when terminal 1, data frame synchronization (FSD), outputs a low level. The FSD pulse
duration is 16 shift clock pulses. Also, in this mode, the control register data bits D10 and D11 appear on
D10OUT and D11OUT, respectively, as outputs.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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