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参数资料
| 型号： | TLE7242-2G |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 模拟信号调理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, PDSO28 |
| 封装： | GREEN, PLASTIC, DSO-28 |
| 文件页数： | 19/50页 |
| 文件大小： | 1210K |
| 代理商： | TLE7242-2G |
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TLE7242-2G
Functional Description and Electrical Characteristics
Data Sheet
26
Rev. 1.0, 2008-07-09
5.6.1
SPI Signal Description
Electrical Characteristics:
V5D = 4.75V to 5.25V, Vbat = 5.5V to 42V,
T
j = -40 °C to +150 °C, all voltages with respect to ground, positive
current flowing into pin (unless otherwise specified)
Pos.
Parameter
Symbol
Limit Values
Unit
Conditions
Min.
Typ.
Max.
5.6.1
TLEAD
t
1
140
–
ns
CS_B falling (0.8V)
to SCK rising (0.8V)
5.6.2
TLAG
t
2
50
–
ns
SCK falling (0.8V)
to CS_B rising
(0.8V)
5.6.3
t
3
450
–
ns
CS_B rise (2.0V) to
CS_B fall (2.0V)
5.6.4
1/FSCK Period of SCK
t
4
100
–
ns
SCK rise to rise
5.6.5
t
5
10
–
ns
SCK falling (0.8V)
to CS_B fall (2.0V)
5.6.6
t
6
40
–
ns
SCK high time (rise
2.0V to fall 2.0V)
5.6.7
t
7
40
–
ns
SCK low time (fall
0.8V to rise 0.8V)
5.6.8
t
8
10
–
ns
CS_B rise (2.0V) to
SCK rise (0.8V)
5.6.9
TSU_SI
t
9
20
–
ns
SI setup time to
SCK rise (0.8V)
5.6.10
THOLD_SI
t
10
20
–
ns
SI hold time after
SCK rise (2.0V)
5.6.11
TSO_ENABLE
t
11
–
110
ns
CS_B fall (2.0V) to
SO Bit0 valid
5.6.12
TVALID
t
12
–
80
ns
SO data valid after
SCK rise (2.0V)
5.6.13
TSO_DISABLE
t
13
–
110
ns
SO tristate after
CS_B rise (2.0V)
5.6.14
Number of clock pulses while CS_B
low
32
–
32
5.6.15
SO rise time
T
SO_RISE
–
50
ns
(20% to 80%)
5.6.16
SO fall time
T
SO_FALL
–
50
ns
(80% to 20%)
5.6.17
Input pin capacitance. CS_B, SI,
and SCK
C
in
––20
pF
5.6.18
SO pin capacitance
C
so
––25
pF
Tristate
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