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参数资料
| 型号： | TMDXEVM5515 |
| 厂商： | Texas Instruments |
| 文件页数： | 81/159页 |
| 文件大小： | 0K |
| 描述： | EVAL MODULE DSP FOR C55XX |
| 标准包装： | 1 |
| 类型： | DSP |
| 适用于相关产品： | TMS320C55x 系列 |
| 所含物品： | 板，线缆，CD，电源 |
| 产品目录页面： | 718 (CN2011-ZH PDF) |
| 其它名称： | 296-25753 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页当前第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页
SPRS645F – AUGUST 2010 – REVISED OCTOBER 2013
5.5.3
Clock PLL Electrical Data/Timing (Input and Output Clocks)
Table 5-4. Timing Requirements for CLKIN (1)
(2)
NO.
CV DD = 1.05 V
MIN NOM
MAX
MIN
CV DD = 1.3 V
NOM
MAX
UNIT
88.577,
88.577,
1
t c(CLKIN)
Cycle time, external clock driven on
CLKIN
83.333,
or
83.333,
or
ns
81.380
81.380
2
3
t w(CLKINH) Pulse width, CLKIN high
t w(CLKINL) Pulse width, CLKIN low
0.466 *
t c(CLKIN)
0.466 *
t c(CLKIN)
0.466 *
t c(CLKIN)
0.466 *
t c(CLKIN)
ns
ns
4
t t(CLKIN)
Transition time, CLKIN
4
4
ns
(1)
(2)
The CLKIN frequency and PLL multiply factor should be chosen such that the resulting clock frequency is within the specific range for
CPU operating frequency.
The reference points for the rise and fall transitions are measured at V IL MAX and V IH MIN.
1
4
1
2
CLKIN
3
4
Figure 5-9. CLKIN Timing
Table 5-5. Switching Characteristics Over Recommended Operating Conditions for CLKOUT (1)
(2)
CV DD = 1.05 V
CV DD = 1.3 V
NO.
PARAMETER
V DDA_PLL = 1.3 V
MIN
MAX
V DDA_PLL = 1.3 V
MIN
MAX
UNIT
1
t c(CLKOUT)
Cycle time, CLKOUT
P
16.67 or
13.33
P
10 or 8.3
ns
2
3
4
5
t w(CLKOUTH)
t w(CLKOUTL)
t t(CLKOUTR)
t t(CLKOUTF)
Pulse duration, CLKOUT high
Pulse duration, CLKOUT low
Transition time (rise), CLKOUT
Transition time (fall), CLKOUT
0.466 *
t c(CLKOUT)
0.466 *
t c(CLKOUT)
5
5
0.466 *
t c(CLKOUT)
0.466 *
t c(CLKOUT)
5
5
ns
ns
ns
ns
(1)
(2)
The reference points for the rise and fall transitions are measured at V OL MAX and V OH MIN.
P = 1/SYSCLK clock frequency in nanoseconds (ns). For example, when SYSCLK frequency is 100 MHz, use P = 10 ns.
2
1
5
CLKOUT
3
4
Figure 5-10. CLKOUT Timing
Copyright ? 2010–2013, Texas Instruments Incorporated
Peripheral Information and Electrical Specifications
Product Folder Links: TMS320C5515
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