参数资料
| 型号： | TRF3750IPWR |
| 厂商： | Texas Instruments |
| 文件页数： | 7/37页 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER PLL FREQ 16-TSSOP |
| 标准包装： | 2,000 |
| 类型： | PLL 频率合成器 |
| PLL： | 无 |
| 输入： | 时钟 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:1 |
| 差分 - 输入:输出： | 是/无 |
| 频率 - 最大： | 2.4GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 带卷 (TR) |
| 配用： | TRF3750T-1900EVM-ND - TRF3750T-1900EVM TRF3750Q1900EVM-ND - TRF3750Q1900EVM 296-20836-ND - EVALUATION MOD FOR CDCM7005-QFN 296-20835-ND - EVALUATION MOD FOR CDCM7005-BGA 296-20834-ND - EVALUATION MOD FOR CDC7005-QFN |
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TRF3750
SLWS146B MARCH 2004 REVISED AUGUST 2007
www.ti.com
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FUNCTIONAL DESCRIPTION
REFIN Stage
This input typically comes from an external oscillator and is the reference used to synthesize the desired
frequency on the output of the complete PLL. The equivalent schematic of this section is given in Figure 24.
The output of this section goes to the R divider, so that the desired PFD frequency can be implemented.
R
PD
PDZ
PD
PDZ
Figure 24. REFIN Stage
RFIN Stage
Figure 25 shows the input stage of the TRF3750. This is where the output of the external VCO is fed back to the
synthesizer. The RFIN signal subsequently feeds the prescaler section.
VBIAS
AVDD
RFIN
RFINB
Figure 25. RFIN Stage
Prescaler Stage
This stage divides down the RFIN frequency before the A and B counters. This is a dual-modulus prescaler and the
user can select any of the following settings: 8/9, 16/17, 32/33, and 64/65.
A and B Counter Stage
The TRF3750 includes a 6-bit A counter and a 13-bit B counter that operate on the output of the prescaler. The A
counter can take values from 0 to 63, while the B counter can take values from 3 to 8191. Also, the value for the B
counter has to be greater than or equal to the value for the A counter. These are CMOS devices, and can easily
operate up to 200 MHz. The selection of the prescaler needs to be such that the resultant frequency does not exceed
the rated 200-MHz threshold.
R Divider
The output of the REFIN stage is fed into the R divider stage. The 14-bit R divider allows the input reference frequency
to be divided down to produce the reference clock to the phase frequency detector (PFD). Division ratios from 1 to
16,383 are allowed.
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PDF描述 |
|---|---|
| MS27473E22F35SB | CONN PLUG 100POS STRAIGHT W/SCKT |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| TRF3750IPWRG4 | 功能描述:时钟合成器/抖动清除器 High Perf Integer-N PLL Freq Synth RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
| TRF3750IRGP | 功能描述:时钟合成器/抖动清除器 Hi Perform Integer-N PLL Freq Synthsizr RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
| TRF3750IRGPG4 | 功能描述:时钟合成器/抖动清除器 Hi Perform Integer-N PLL Freq Synthsizr RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
| TRF3750IRGPR | 功能描述:时钟合成器/抖动清除器 High Perf Integer-N PLL Freq Synth RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
| TRF3750IRGPRG4 | 功能描述:时钟合成器/抖动清除器 High Perf Integer-N PLL Freq Synth RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
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