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参数资料
| 型号： | TSC21020F-20SB-E |
| 英文描述： | IC CYCLONE III FPGA 40K 780 FBGA |
| 中文描述： | 数字信号处理器| 32位|的CMOS | RAD数据通信硬| QFL | 256PIN |陶瓷 |
| 文件页数： | 13/51页 |
| 文件大小： | 763K |
| 代理商： | TSC21020F-20SB-E |
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13
TSC21020F
4153F
–
AERO
–
06/03
TCK
I
Test Clock. Provides an asynchronous clock for JTAG boundary scan.
TMS
I/S
Test Mode Select. Used to control the test state machine. TMS has a
20 k
internal pull-up resistor.
TDI
I/S
Test Data Input. Provides serial data for the boundary scan logic. TDI
has a 20 k
internal pull-up resistor.
TDO
O
Test Data Output. Serial scan output of the boundary scan path.
TRST
I/A
Test Reset. Resets the test state machine. TRST must be asserted
(pulsed low) after power-up or held low for proper operation of the
TSC21020F. TRST has a 20 k
internal pull-up resistor.
NC
No Connect. No Connects are reserved pins that must be left open and
unconnected.
Table 1.
PGA Pin Configuration
PGA
Location
Name
Pin
PGA
Location
Pin
Name
PGA
Location
Pin
Name
PGA
Location
Pin
Name
G16
DMA0
B5
DMD25
K1
PMD9
L16
TIMEXP
G17
DMA1
B6
DMD26
L3
PMD10
U12
RCOMP
F18
DMA2
D6
DMD27
L2
PMD11
T11
CLKIN
F17
DMA3
C6
DMD28
M1
PMD12
T14
TRST
F16
DMA4
A8
DMD29
M2
PMD13
R12
TD0
F15
DMA5
C7
DMD30
M3
PMD14
S13
TDI
E18
DMA6
D7
DMD31
M4
PMD15
U16
TMS
E17
DMA7
B7
DMD32
N2
PMD16
U14
TCK
E16
DMA8
B8
DMD33
N3
PMD17
H18
EGND
D18
DMA9
A10
DMD34
P1
PMD18
A3
EGND
E15
DMA10
C8
DMD35
P2
PMD19
A7
EGND
D17
DMA11
D8
DMD36
N4
PMD20
A11
EGND
D16
DMA12
B9
DMD37
S1
PMD21
A15
EGND
C18
DMA13
C9
DMD38
P3
PMD22
E1
EGND
C17
DMA14
B10
DMD39
R2
PMD23
G1
EGND
D15
DMA15
D10
DMS0
P4
PMD24
L1
EGND
B18
DMA16
C11
DMS1
R3
PMD25
L18
EGND
B17
DMA17
A12
DMS2
S2
PMD26
R1
EGND
C16
DMA18
B11
DMS3
T1
PMD27
R18
EGND
D14
DMA19
T13
DMWR
S3
PMD28
T18
EGND
C15
DMA20
S11
DMRD
R4
PMD29
U5
EGND
B16
DMA21
B12
DMPAGE
T2
PMD30
U7
EGND
Pin Name
Type
Function
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PDF描述 |
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参数描述 |
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