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参数资料
| 型号： | UPD70F3750GK-GAK-AX |
| 厂商： | Renesas Electronics America |
| 文件页数： | 26/191页 |
| 文件大小： | 0K |
| 描述： | MCU 32BIT V850ES/HX3 80-LQFP |
| 标准包装： | 300 |
| 系列： | V850ES/Hx3 |
| 核心处理器： | V850ES |
| 芯体尺寸： | 32-位 |
| 速度： | 32MHz |
| 连通性： | CSI，I²C，UART/USART |
| 外围设备： | DMA，LVD，PWM，WDT |
| 输入/输出数： | 67 |
| 程序存储器容量： | 256KB（256K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 16K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3.7 V ~ 5.5 V |
| 数据转换器： | A/D 12x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 80-LQFP |
| 包装： | 托盘 |
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User’s Manual U18854EJ2V0UD
14
15.5
Interrupt Request Signals.................................................................................................... 682
15.6
Operation............................................................................................................................... 683
15.6.1
Single transfer mode (master mode, transmission mode)........................................................ 683
15.6.2
Single transfer mode (master mode, reception mode) ............................................................. 685
15.6.3
Single transfer mode (master mode, transmission/reception mode) ........................................687
15.6.4
Single transfer mode (slave mode, transmission mode) ..........................................................689
15.6.5
Single transfer mode (slave mode, reception mode)................................................................ 691
15.6.6
Single transfer mode (slave mode, transmission/reception mode)...........................................693
15.6.7
Continuous transfer mode (master mode, transmission mode) ............................................... 695
15.6.8
Continuous transfer mode (master mode, reception mode) .....................................................697
15.6.9
Continuous transfer mode (master mode, transmission/reception mode) ................................700
15.6.10 Continuous transfer mode (slave mode, transmission mode) ..................................................703
15.6.11 Continuous transfer mode (slave mode, reception mode) .......................................................705
15.6.12 Continuous transfer mode (slave mode, transmission/reception mode) ..................................708
15.6.13 Reception error ........................................................................................................................711
15.6.14 Clock timing .............................................................................................................................712
15.7
Output Pin Status with Operation Disabled....................................................................... 714
15.8
Baud Rate Generator............................................................................................................ 715
15.8.1
Baud rate generation ...............................................................................................................716
15.9
Cautions ................................................................................................................................ 716
CHAPTER 16 I
2C BUS .......................................................................................................................... 717
16.1
Mode Switching of I
2C Bus and Other Serial Interfaces ................................................... 717
16.1.1
UARTD4 and I
2C00 mode switching ........................................................................................717
16.2
Features................................................................................................................................. 718
16.3
Configuration ........................................................................................................................ 721
16.4
Registers ............................................................................................................................... 723
16.5
Functions............................................................................................................................... 738
16.5.1
Pin configuration ......................................................................................................................738
16.6
I
2C Bus Definitions and Control Methods .......................................................................... 739
16.6.1
Start condition..........................................................................................................................739
16.6.2
Addresses................................................................................................................................740
16.6.3
Transfer direction specification ................................................................................................741
16.6.4
ACK# .......................................................................................................................................742
16.6.5
Stop condition ..........................................................................................................................743
16.6.6
Wait state.................................................................................................................................744
16.6.7
Wait state cancellation method ................................................................................................746
16.7
I
2C Interrupt Request Signals (INTIIC0) .............................................................................. 747
16.7.1
Master device operation...........................................................................................................748
16.7.2
Slave device operation (when receiving slave address data (address match))........................751
16.7.3
Slave device operation (when receiving extension code) ........................................................755
16.7.4
Operation without communication............................................................................................759
16.7.5
Arbitration loss operation (operation as slave after arbitration loss).........................................760
16.7.6
Operation when arbitration loss occurs (no communication after arbitration loss) ...................762
16.8
Interrupt Request Signal (INTIIC0) Generation Timing and Wait Control....................... 769
16.9
Address Match Detection Method ...................................................................................... 770
16.10 Error Detection...................................................................................................................... 770
16.11 Extension Code..................................................................................................................... 770
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