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参数资料
| 型号： | UPD78F0394GC-8EA-A |
| 厂商： | Renesas Electronics America |
| 文件页数： | 30/682页 |
| 文件大小： | 0K |
| 描述： | MCU 8BIT 48KB FLASH |
| 标准包装： | 400 |
| 系列： | 78K0/Lx2 |
| 核心处理器： | 78K/0 |
| 芯体尺寸： | 8-位 |
| 速度： | 20MHz |
| 连通性： | 3 线 SIO，I²C，LIN，UART/USART |
| 外围设备： | LCD，LVD，POR，PWM，WDT |
| 输入/输出数： | 40 |
| 程序存储器容量： | 48KB（48K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 100-LQFP |
| 包装： | 托盘 |
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CHAPTER 6 CLOCK GENERATOR
User’s Manual U17473EJ2V0UD
123
Figure 6-2. Format of Clock Operation Mode Select Register (OSCCTL)
Address: FF9FH
After reset: 00H
R/W
Symbol
<7>
<6>
<5>
<4>
3
2
1
<0>
OSCCTL
EXCLK
OSCSEL
EXCLKS
Note
OSCSELS
Note
0
AMPH
EXCLK
OSCSEL
High-speed system clock
pin operation mode
P121/X1 pin
P122/X2/EXCLK pin
0
I/O port mode
I/O port
0
1
X1 oscillation mode
Crystal/ceramic resonator connection
1
0
I/O port mode
I/O port
1
External clock input
mode
I/O port
External clock input
AMPH
Operating frequency control
0
1 MHz
≤ fXH ≤ 10 MHz
1
10 MHz < fXH
≤ 20 MHz
Note
EXCLKS and OSCSELS are used in combination with XTSTART (bit 6 of the processor
clock control register (PCC)). See (3) Setting of operation mode for subsystem clock
pin.
Cautions 1. Be sure to set AMPH to 1 if the high-speed system clock oscillation frequency
exceeds 10 MHz.
2. Set AMPH before setting the peripheral functions after a reset release. The value
of AMPH can be changed only once after a reset release. When the high-speed
system clock (X1 oscillation) is selected as the CPU clock, supply of the CPU
clock is stopped for 4.06 to 16.12
μs after AMPH is set to 1. When the high-
speed system clock (external clock input) is selected as the CPU clock, supply of
the CPU clock is stopped for the duration of 160 external clocks after AMPH is
set to 1.
3. If the STOP instruction is executed when AMPH = 1, supply of the CPU clock is
stopped for 4.06 to 16.12
μs after the STOP mode is released when the internal
high-speed oscillation clock is selected as the CPU clock, or for the duration of
160 external clocks when the high-speed system clock (external clock input) is
selected as the CPU clock. When the high-speed system clock (X1 oscillation) is
selected as the CPU clock, the oscillation stabilization time is counted after the
STOP mode is released.
4. To change the value of EXCLK and OSCSEL, be sure to confirm that bit 7
(MSTOP) of the main OSC control register (MOC) is 1 (the X1 oscillator stops or
the external clock from the EXCLK pin is disabled).
Remark
fXH: High-speed system clock oscillation frequency
<R>
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