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参数资料
| 型号： | W204 |
| 英文描述： | Clocks and Buffers |
| 中文描述： | 时钟和缓冲器 |
| 文件页数： | 14/16页 |
| 文件大小： | 177K |
| 代理商： | W204 |
W204
PRELIMINARY
Document #: 38-07264 Rev. *A
Page 14 of 16
48-MHz0:1 Clock Output (Lump Capacitance Test Load = 20 pF = 66.6/100 MHz)
Parameter
f
f
D
m/n
t
R
t
F
t
D
f
ST
Description
Test Condition/Comments
Determined by PLL divider ratio (see m/n below)
(48.008
–
48)/48
(14.31818 MHz x 57/17 = 48.008 MHz)
Measured from 0.4V to 2.4V
Measured from 2.4V to 0.4V
Measured on rising and falling edge at 1.5V
Assumes full supply voltage reached within 1 ms
from power-up. Short cycles exist prior to fre-
quency stabilization.
Average value during switching transition. Used
for determining series termination value.
CPU = 66.8/100 MHz
Min.
Typ.
48.008
+167
57/17
0.5
0.5
45
Unit
MHz
ppm
Max.
Frequency, Actual
Deviation from 48 MHz
PLL Ratio
Output Rise Edge Rate
Output Fall Edge Rate
Duty Cycle
Frequency Stabilization
from Power-up (cold start)
2
2
V/ns
V/ns
%
ms
55
3
Z
o
AC Output Impedance
40
Ordering Information
Ordering Code
W204
Package
Name
H
Package Type
48-pin SSOP (300 mils)
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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