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参数资料
| 型号： | WJLXT905LE.C2 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP32 |
| 封装： | ROHS COMPLIANT, MO-136BC, LQFP-32 |
| 文件页数： | 8/40页 |
| 文件大小： | 544K |
| 代理商： | WJLXT905LE.C2 |
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LXT905 Universal 10BASE-T Transceiver with 3.3V Support
16
Datasheet
Document Number: 249271
Revision Number: 004
Revision Date: 19-Oct-2005
2.10
Link Integrity Test Function
Figure 7 is a state diagram of the LXT905 link integrity test function. The link integrity test
determines the status of the receive side twisted-pair cable. Link integrity testing is enabled when
LI is tied High. When enabled, the receiver recognizes link integrity pulses that transmit in the
absence of receive traffic. If the LXT905 does not detect any serial data stream or link integrity
pulses within 50~150 ms, the chip enters a link fail state and disables the transmit and normal
loopback functions. The LXT905 ignores any link integrity pulse with an interval less than 2~7 ms.
The LXT905 remains in the link fail state until it detects either a serial data packet, or two or more
link integrity pulses.
Table 3.
Loopback Modes
Pin Settings
Mode Description
LBK
LEDC/FDE
Low
Disable internal loopback.
Enable external loopback test mode and full-duplex mode.
Low
High
Standard loopback mode (default).
Internally loops back data that the MAC transmitted, and returns the data to the
MAC, except during collision.
A data collision disables standard loopback, clearing RXD for data on the twisted-
pair port.
High
Low
Not Used.
High
Forced internal loopback.
Loops-back transmit data on the receive data bus, and ignores the twisted-pair
port.
相关PDF资料 |
PDF描述 |
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