参数资料
| 型号： | XA3S250E-4PQG208Q |
| 厂商： | Xilinx Inc |
| 文件页数： | 27/37页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SPARTAN-3E 250K 208-PQFP |
| 标准包装： | 24 |
| 系列： | Spartan®-3E XA |
| LAB/CLB数： | 612 |
| 逻辑元件/单元数： | 5508 |
| RAM 位总计： | 221184 |
| 输入/输出数： | 158 |
| 门数： | 250000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 208-BFQFP |
| 供应商设备封装： | 208-PQFP（28x28） |
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DS635 (v2.0) September 9, 2009
Product Specification
33
R
Serial Peripheral Interface Configuration Timing
Table 40: Timing for SPI Configuration Mode
Symbol
Description
Minimum
Maximum
Units
TCCLK1
Initial CCLK clock period
(see Table 34)
TCCLKn
CCLK clock period after FPGA loads ConfigRate setting
(see Table 34)
TMINIT
Setup time on VS[2:0] and M[2:0] mode pins before the rising
edge of INIT_B
50
-ns
TINITM
Hold time on VS[2:0] and M[2:0]mode pins after the rising edge of
INIT_B
0
-ns
TCCO
MOSI output valid after CCLK edge
See Table 38
TDCC
Setup time on DIN data input before CCLK edge
See Table 38
TCCD
Hold time on DIN data input after CCLK edge
See Table 38
Table 41: Configuration Timing Requirements for Attached SPI Serial Flash
Symbol
Description
Requirement
Units
TCCS
SPI serial Flash PROM chip-select time
ns
TDSU
SPI serial Flash PROM data input setup time
ns
TDH
SPI serial Flash PROM data input hold time
ns
TV
SPI serial Flash PROM data clock-to-output time
ns
fC or fR
Maximum SPI serial Flash PROM clock frequency (also depends
on specific read command used)
MHz
Notes:
1.
These requirements are for successful FPGA configuration in SPI mode, where the FPGA provides the CCLK frequency. The post
configuration timing can be different to support the specific needs of the application loaded into the FPGA and the resulting clock source.
2.
Subtract additional printed circuit board routing delay as required by the application.
T
CCS
T
MCCL1
T
CCO
–
≤
T
DSU
T
MCCL1
T
CCO
–
≤
T
DH
T
MCCH1
≤
T
V
T
MCCLn
T
DCC
–
≤
f
C
1
T
CCLKn min
()
-------------------------------
≥
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