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参数资料
| 型号： | XC2C32A-3CP56C |
| 厂商： | XILINX INC |
| 元件分类： | PLD |
| 英文描述： | FLASH PLD, 3 ns, PBGA56 |
| 封装： | 6 X 6 MM, 0.50 MM PITCH, CSP-56 |
| 文件页数： | 10/13页 |
| 文件大小： | 264K |
| 代理商： | XC2C32A-3CP56C |
XC2C32A CoolRunner-II CPLD
6
DS310 (v1.1) August 30, 2004
1-800-255-7778
Advance Product Specification
R
Internal Timing Parameters
Symbol
Parameter(1)
-3
-4
-6
Units
Min.
Max.
Min.
Max.
Min.
Max.
Buffer Delays
TIN
Input buffer delay
-
0.8
-
1.3
-
1.7
ns
TDIN
Direct register input delay
-
1.2
-
1.5
-
2.4
ns
TGCK
Global Clock buffer delay
-
1.2
-
1.3
-
2.0
ns
TGSR
Global set/reset buffer delay
-
1.2
-
1.6
-
2.0
ns
TGTS
Global 3-state buffer delay
-
0.8
-
1.3
-
2.1
ns
TOUT
Output buffer delay
-
1.4
-
1.8
-
2.0
ns
TEN
Output buffer enable/disable delay
-
3.2
-
2.9
-
3.4
ns
P-term Delays
TCT
Control term delay
-
1.3
-
1.3
-
1.6
ns
TLOGI1
Single p-term delay adder
-
0.4
-
0.4
-
1.1
ns
TLOGI2
Multiple p-term delay adder
-
0.2
-
0.2
-
0.5
ns
Macrocell Delay
TPDI
Input to output valid
-
0.2
-
0.3
-
0.7
ns
TLDI
Setup before clock (transparent
latch)
-
1.0
-
1.5
-
2.5
ns
TSUI
Setup before clock
1.5
-
1.5
-
1.8
-
ns
THI
Hold after clock
0.0
-
0.0
-
0.0
-
ns
TECSU
Enable clock setup time
0.9
-
0.7
-
1.7
-
ns
TECHO
Enable clock hold time
0.0
-
0.0
-
0.0
-
ns
TCOI
Clock to output valid
-
0.2
-
0.6
-
0.7
ns
TAOI
Set/reset to output valid
-
1.4
-
1.1
-
1.5
ns
Feedback Delays
TF
Feedback delay
-
0.3
-
0.6
-
1.4
ns
TOEM
Macrocell to global OE delay
-
0.2
-
0.2
-
0.8
ns
I/O Standard Time Adder Delays 1.5V I/O
THYS15
Hysteresis input adder
-
2.5
-
3.0
-
4.0
ns
TOUT15
Output adder
-
0.5
-
0.8
-
1.0
ns
TSLEW15
Output slew rate adder
-
3.0
-
4.0
-
5.0
ns
I/O Standard Time Adder Delays 1.8V CMOS
THYS18
Hysteresis input adder
-
2.0
-
3.0
-
4.0
ns
TOUT18
Output adder
-
0.0
-
0.0
-
0.0
ns
TSLEW
Output slew rate adder
-
3.0
-
4.0
-
5.0
ns
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