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参数资料
| 型号： | XC68307FG8V |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16.67 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | PLASTIC, QFP-100 |
| 文件页数： | 19/35页 |
| 文件大小： | 172K |
| 代理商： | XC68307FG8V |
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26
MC68307 TECHNICAL INFORMATION
MOTOROLA
a. Wait states can be added.
Figure 10. Bus Arbitration Timing
PRELIMINARY 8051 BUS INTERFACE MODULE
AC ELECTRICAL SPECIFICATIONS
(VCC = 5.0V ± 0.5V or 3.3Vdc ± 0.3V; GND = 0Vdc; TA = TL to TH) (See Figures 11 and 12)
Symbol
Characteristic
3.3V
5V
Unit
8 MHz
16.67 MHz
Min
Max
Min
Max
tcyc
Cycle time
120
—
60
—
ns
TLHLL
ALE pulse width
2 x tcyc – 40
—
2 x tcyc – 40
—
ns
TAVLL
Address valid to ALE low
tcyc – 40
—
tcyc – 40
—
ns
TLLAX
Address hold after ALE low
tcyc – 35
—
tcyc – 35
—
ns
TRLRH
RD pulse widtha
5 x tcyc
—
5 x tcyc
—8051
ns
TWLWH
WR pulse width(1)
5 x tcyc
—
5 x tcyc
—
ns
TRLDV
RD low to valid data in(1)
—
5 x tcyc – 165
—
5 x tcyc – 165
ns
TRHDX
Data hold after RD
0
—
0
—
ns
TRHDZ
Data float after RD
—
0.5 x tcyc
—
0.5 x tcyc
ns
TLLDV
ALE low to valid data in(1)
—
8 x tcyc – 150
—
8 x tcyc – 150
ns
TAVDV
Address to valid data in(1)
—
9 x tcyc – 165
—
9 x tcyc – 165
ns
TLLWL
ALE low to RD or WR low
3 x tcyc– 50 3 x tcyc + 50 3 x tcyc– 50 3 x tcyc + 50
ns
TAVWL
Address to RD low or WR low
4 x tcyc – 130
—
4 x tcyc – 130
—
ns
TQVWX
Data valid to WR transition
tcyc – 60
—
tcyc – 60
—
ns
TQVWH
Data valid to WR high(1)
7 x tcyc– 150
—
7 x tcyc– 150
—
ns
TWHQX
Data held after WR
tcyc– 50
—
tcyc– 50
—
ns
TRLAZ
RD low to address float
—
ns
TWHLH
RD or WR high to ALE high
tcyc– 40
tcyc+ 50
tcyc– 40
tcyc+ 50
ns
NOTE:
CLK
Strobes
BR
BGACK
BG
R/W
and
36
35
46
39
34
38
33
37
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