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参数资料
| 型号： | XC68HC705X4DW |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 2.2 MHz, MICROCONTROLLER, PDSO28 |
| 封装： | SOIC-28 |
| 文件页数： | 156/168页 |
| 文件大小： | 656K |
| 代理商： | XC68HC705X4DW |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页当前第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页
Motorola CAN
MC68HC05X4
88
Motorola CAN
MOTOROLA
MCAN bus timing
register 0 (CBT0)
NOTE:
This register can be accessed only when the RR bit in CCNTRL is set.
SJW1, SJW0 — Synchronization jump width bits
The synchronization jump width defines the maximum number of
system clock (tSCL) cycles by which a bit may be shortened, or
lengthened, to achieve resynchronization on data transitions on the
bus (see Table 1).
BRP5 – BRP0 — Baud rate prescaler bits
These bits determine the MCAN system clock cycle time (tSCL), which
is used to build up the individual bit timing, according to Table 2 and
the formula in Figure 11.
Address:
$0026
Bit 7
654321
Bit 0
SJW1
SJW0
BRP5
BRP4
BRP3
BRP2
BRP1
BRP0
Reset:
Undened
Figure 10. MCAN Bus Timing 0 (CBT0)
Table 1. Synchronization jump width
SJW1
SJW0
Synchronization jump width
0
1 tSCL cycle
0
1
2 tSCL cycles
1
0
3 tSCL cycles
1
4 tSCL cycles
Table 2. Baud rate prescaler
BRP5
BRP4
BRP3
BRP2
BRP1
BRP0
Prescaler value (P)
0
00000
1
0
00001
2
0
00010
3
0
00011
4
:
:::::
:
:::::
:
1
11111
64
20-mcan
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