参数资料
| 型号： | XCV100E-6BG352C |
| 厂商： | Xilinx Inc |
| 文件页数： | 34/233页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 1.8V 128K GATES 352-MBGA |
| 产品变化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 标准包装： | 24 |
| 系列： | Virtex®-E |
| LAB/CLB数： | 600 |
| 逻辑元件/单元数： | 2700 |
| RAM 位总计： | 81920 |
| 输入/输出数： | 196 |
| 门数： | 128236 |
| 电源电压： | 1.71 V ~ 1.89 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 352-LBGA，金属 |
| 供应商设备封装： | 352-MBGA（35x35） |
| 其它名称： | 122-1216 XCV100E-6BG352C-ND |
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
DS022-4 (v3.0) March 21, 2014
Module 4 of 4
Production Product Specification
43
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
47
2
F4
C1
14
-
48
2
G5
E3
15
VREF
49
2
D2
G4
16
-
50
2
H5
E2
15
-
51
2
H4
G3
√
VREF
52
2
J5
F1
17
VREF
53
2
J4
H3
14
-
54
2
K5
H2
18
VREF
55
2
J3
K4
19
-
56
2
L5
K3
√
D1
57
2
L4
K2
√
D2
58
2
M5
L3
17
-
59
2
L1
M4
14
-
60
2
N5
M2
15
VREF
61
2
N4
N3
16
-
62
2
N2
P5
15
-
63
2
P4
P3
√
D3
64
2
P2
R5
17
-
65
2
R4
R3
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-
66
2
R1
T4
18
VREF
67
2
T5
T3
19
VREF
68
2
T2
U3
√
-
69
3
U1
U2
19
VREF
70
3
V2
V4
18
VREF
71
3
V5
V3
14
-
72
3
W1
W3
17
-
73
3
W4
W5
√
VREF
74
3
Y3
Y4
15
-
75
3
AA1
Y5
16
-
76
3
AA3
AA4
15
VREF
77
3
AB3
AA5
14
-
Table 15: BG560 Differential Pin Pair Summary
XCV400E, XCV600E, XCV1000E, XCV1600E, XCV2000E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
783AC1
AB4
17
-
793AC3
AB5
√
D5
803AC4
AD3
√
VREF
81
3
AE1
AC5
4
-
82
3
AD4
AF1
18
VREF
83
3
AF2
AD5
14
-
84
3
AG2
AE4
20
VREF
85
3
AH1
AE5
√
VREF
86
3
AF4
AJ1
15
-
87
3
AJ2
AF5
14
-
88
3
AG4
AK2
15
VREF
89
3
AJ3
AG5
14
-
90
3
AL1
AH4
14
VREF
91
3
AJ4
AH5
√
INIT
92
4
AL4
AJ6
√
-
93
4
AK5
AN3
8
VREF
94
4
AL5
AJ7
√
-
95
4
AM4
AM5
√
VREF
96
4
AK7
AL6
3
-
97
4
AM6
AN6
√
-
98
4
AL7
AJ9
√
VREF
99
4
AN7
AL8
9
VREF
100
4
AM8
AJ10
7
-
101
4
AL9
AM9
7
VREF
102
4
AK10
AN9
2
-
103
4
AL10
AM10
√
VREF
104
4
AL11
AJ12
√
-
105
4
AN11
AK12
8
-
106
4
AL12
AM12
√
-
107
4
AK13
AL13
√
VREF
108
4
AM13
AN13
3
-
Table 15: BG560 Differential Pin Pair Summary
XCV400E, XCV600E, XCV1000E, XCV1600E, XCV2000E
Pair
Bank
P
Pin
N
Pin
AO
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