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参数资料
型号： XE8000EV110
厂商： Semtech
文件页数： 122/193页
文件大小： 0K
描述： EVAL BOARD FOR XE8802AMI035LF
标准包装： 1
类型： MCU
适用于相关产品： XE88LC02MI035
所含物品： 完全组装的评估板
产品目录页面： 585 (CN2011-ZH PDF)
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Semtech 2006
www.semtech.com
4-7
XE8802 Sensing Machine Data Acquisition MCU
with ZoomingADC and LCD driver
4.3.9
Interrupt handler (h0040-h0047)
Name
Address
7
6
5
4
3
2
1
0
RegIrqHig
h0040
IrqAC
rc1,0,glob
128Hz
rc1,0,glob
IrqSPI
rc1,0,glob
CntIrqA
rc1,0,glob
CntIrqC
rc1,0,glob
CmpdIrq
rc1,0,glob
UartIrqTx
rc1,0,glob
UartIrqRx
rc1,0,glob
RegIrqMid
h0041
UsrtCond2
rc1,0,glob
UrstCond1
rc1,0,glob
PAIrq[5]
rc1,0,glob
PAIrq[4]
rc1,0,glob
1Hz
rc1,0,glob
VldIrq
rc1,0,glob
PAIrq[1]
rc1,0,glob
PAIrq[0]
rc1,0,glob
RegIrqLow
h0042
PAIrq[7]
rc1,0,glob
PAIrq[6]
rc1,0,glob
CntIrqB
rc1,0,glob
CntIrqD
rc1,0,glob
PAIrq[3]
rc1,0,glob
PAIrq[2]
rc1,0,glob
r0
RegIrqEnHig
h0043
IrqEnHig[7:0]
rw,0000000,glob
RegIrqEnMid
h0044
IrqEnMid[7:0]
rw,0000000,glob
RegIrqEnLow
h0045
IrqEnLow[7:0]
rw,0000000,glob
RegIrqPriority
h0046
IrqPriority[7:0]
r,11111111,glob
RegIrqIrq
h0047
r0
IrqHig
r,0,glob
IrqMid
r,0,glob
IrqLow
r,0,glob
Table 4-4-11. Interrupt handler registers
The origin of the different interrupts is summarised in the table below.
Event
Event source
CmpdIrq
Low power comparators
CntIrqA
Counter/Timer A (counter block)
CntIrqB
Counter/Timer B (counter block)
CntIrqC
Counter/Timer C (counter block)
CntIrqD
Counter/Timer D (counter block)
128Hz
Low prescaler (clock block)
1Hz
Low prescaler (clock block)
PAIrq[7:0]
Port A
UartIrqRx
UART reception
UartIrqTx
UART transmission
UrstCond1
USRT condition 1
UsrtCond2
USRT condition 2
VldIrq
Voltage level detector
IrqAC
Acquisition chain end of conversion interrupt
IrqSPI
SPI end of reception/transmission interrupt
Table 4-4-12. Interrupt source description
4.3.10
USRT (h0048-h004F)
Name
Address
7
6
5
4
3
2
1
0
RegUsrtS1
h0048
r0
UsrtS1
s,1,glob
RegUsrtS0
h0049
r0
UsrtS0
s,1,glob
RegUsrtCond1
h004A
r0
UsrtCond1
rc,0,glob
RegUsrtCond2
h004B
r0
UsrtCond2
rc,0,glob
RegUsrtCtrl
h004C
r0
UsrtWaitS0
r,0,glob
UsrtEnWaitCond1
rw,0,glob
UsrtEnWaitS0
rw,0,glob
UsrtEnable
rw,0,glob
RegUsrtBufferS1
h004D
r0
UsrtBufferS1
r,0,glob
RegUsrtEdgeS0
h004E
r0
UsrtEdgeS0
r,0,glob
Table 4-4-13. USRT register description
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