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参数资料
| 型号： | XE8000EV110 |
| 厂商： | Semtech |
| 文件页数： | 27/193页 |
| 文件大小： | 0K |
| 描述： | EVAL BOARD FOR XE8802AMI035LF |
| 标准包装： | 1 |
| 类型： | MCU |
| 适用于相关产品： | XE88LC02MI035 |
| 所含物品： | 完全组装的评估板 |
| 产品目录页面： | 585 (CN2011-ZH PDF) |
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Semtech 2006
www.semtech.com
17-10
XE8802 Sensing Machine Data Acquisition MCU
with ZoomingADC and LCD driver
PGA3_OFFSET[6:0]
PGA3 Offset
GDoff3 (V/V)
0000000
0
0000001
+1/12(=+0.083)
0000010
+2/12
...
0010000
+16/12
...
0100000
+32/12
...
0111111
+63/12(=+5.25)
1000000
0
1000001
-1/12(=-0.083)
1000010
-2/12
...
1010000
-16/12
...
1100000
-32/12
...
1111111
-63/12(=-5.25)
Table 17-18. PGA3 offset settings
17.6.1
PGA & ADC Enabling
Depending on the application objectives, the user may enable or bypass each PGA stage. This is done using the
word ENABLE and the coding given in Table 17-13. To reduce power dissipation, the ADC can also be inactivated
while idle.
17.6.2
PGA1
The first stage can have a buffer function (unity gain) or provide a gain of 10 (see Table 17-14). The voltage VD1 at
the output of PGA1 is:
IN
D
V
GD
V
=
1
(V)
(Eq. 5)
where GD1 is the gain of PGA1 (in V/V) controlled with the bit PGA1_GAIN.
17.6.3
PGA2
The second PGA has a finer gain and offset tuning capability, as shown in Table 17-15 and Table 17-16. The
voltage VD2 at the output of PGA2 is given by:
REF
D
V
GDoff
V
GD
V
=
2
1
2
(V)
(Eq. 6)
where GD2 and GDoff2 are respectively the gain and offset of PGA2 (in V/V). These are controlled with the words
PGA2_GAIN[1:0]
and PGA2_OFFSET[3:0] .
17.6.4
PGA3
The finest gain and offset tuning is performed with the third and last PGA stage, according to the coding of Table
17-17 and Table 17-18. The output of PGA3 is also the input of the ADC. Thus, similarly to PGA2, we find that the
voltage entering the ADC is given by:
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