参数资料
| 型号： | XRT75L06IB-F |
| 厂商： | Exar Corporation |
| 文件页数： | 54/63页 |
| 文件大小： | 0K |
| 描述： | IC LIU E3/DS3/STS-1 6CH 217BGA |
| 标准包装： | 60 |
| 类型： | 线路接口装置（LIU） |
| 驱动器/接收器数： | 6/6 |
| 规程： | DS3，E3，STS-1 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 217-BBGA |
| 供应商设备封装： | 217-BGA（23x23） |
| 包装： | 托盘 |
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XRT75L06
REV. 1.0.3
SIX CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER ATTENUATOR
55
0x07 (Ch 0)
0x17 (Ch 1)
0x27 (Ch 2)
0x37 (ch 3)
0x47 (ch 4)
0x57 (ch 5)
R/W
Jitter
Attenuator
D0
JA0_n
This bit along with JA1_n bit configures the Jitter
Attenuator as shown in the table below.
0
D1
JATx/Rx_n Setting this bit selects the Jitter Attenuator in the
Transmit Path. A “0” selects in the Receive Path.
0
D2
JA1_n
This bit along with the JA0_n configures the Jitter
Attenuator as shown in the table.
0
D3
PNTRST_n Setting this bit resets the FIFO pointers to their initial
state and flushes the FIFO. All existing FIFO data is
lost.
0
D4
DFLCK_n
Set this bit to “1” to disable fast locking of the PLL.
This helps to reduce the time for the PLL to lock to
incoming frequency when the Jitter Attenuator
switches to narrow band.
0
D7-D5
Reserved
TABLE 18: REGISTER MAP DESCRIPTION - CHANNEL N
ADDRESS
(HEX)
TYPE
REGISTER
NAME
BIT#
SYMBOL
DESCRIPTION
DEFAULT
VALUE
JA0_n
0
Mode
16 bit FIFO
32 bit FIFO
JA1_n
0
1
Disable Jitter
Attenuator
0
1
Disable Jitter
Attenuator
相关PDF资料 |
PDF描述 |
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| XRT75R06IB-F | IC LIU E3/DS3/STS-1 6CH 217BGA |
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相关代理商/技术参数 |
参数描述 |
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